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STATUS_LD2，默认的是PLL2 sync是对边沿敏感还是极性敏感也是通过寄存器来配置的，比如电平高低敏感，则bit6=0. reset |
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您可以只使用三线SPI
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根据您的描述，您在使用LMK04821NKDT芯片时遇到了SPI通信问题。在FPGA对时钟芯片SPI配置时，RESET、SYNC和STATUS_LD2的状态应该是：
1. RESET：在配置过程中，RESET应该保持低电平。当配置完成后，将其设置为高电平以使芯片正常工作。 2. SYNC：SYNC信号用于同步时钟输出。在配置过程中，SYNC应该保持高电平。当配置完成后，根据需要将其设置为高电平或低电平。 3. STATUS_LD2：STATUS_LD2是一个输出引脚，用于指示芯片的状态。在配置过程中，您不需要关心STATUS_LD2的状态，因为它是由芯片内部控制的。 您可以尝试以下步骤来解决问题： 1. 确保FPGA的SPI接口配置正确，包括时钟频率、CPOL和CPHA等参数。 2. 检查FPGA与LMK04821NKDT芯片之间的连接，确保没有短路或断路。 3. 在配置过程中，确保RESET、SYNC和STATUS_LD2的状态正确。如上所述，RESET应保持低电平，SYNC应保持高电平。 4. 使用示波器检查SPI通信波形，确保SPI通信正常。 5. 如果可能，尝试使用其他FPGA板或LMK04821NKDT芯片进行测试，以排除硬件故障的可能性。 6. 如果问题仍然存在，请联系TI技术支持，提供详细的测试结果和配置信息，以便他们能够更好地帮助您解决问题。 |
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只有小组成员才能发言，加入小组>>
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