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我尝试将RTT移植到Vitis2019.2工程中,硬件平台为Zynq Ultrascale+ MPSoC ZU3EG 的自制板子。我已经移植了RTT源码/bsp/zynqmp-r5-axu4ev,和/libcpu/arm/zynqmp-r5,/src源码,/include头文件,以及/components中的必要组件。我正确的设置了各头文件的工程路径,但在Vitis2019.2工程中Build时报错大量错误,大多都是头文件找不到,变量重复定义等。
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3个回答
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我玩 Zynq Ultrascale+ 的时候,直接用 scons 编译出 elf,然后在 Vitis 里面直接选择加载这个 elf 就可以玩了
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根据您的回答,我的理解是,我应该直接在bspzynqmp-r5-axu4evapplications下添加并编写PS端用户应用代码,然后直接用 scons 编译出 elf 文件,作为 bif 的第 3 个文件。整个开发、编译过程都不使用 Vitis 界面?
然后用 Vivado 导出的硬件平台,通过 Vitis 创建 FSBL 工程,编译生成 fsbl.elf 文件,作为 bif 的第 1 个文件。 再用 Vivado 导出的 .bit 文件作为 bif 的第 2 个文件。 再用上述 3 个文件,通过 Vitis 生成 BIN 文件。 是这样吗? |
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