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有谁知道为什么transcieverwizard会建立一个7位移位寄存器来跨越时钟域？
此代码位于示例设计重置状态机* _sync.v块中。 这是针对V7的吗？ 谢谢， Roopa 
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2个回答
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是。
它是V7特定的。 您可以找到其他设备的更改阶段数。 这是基于对MTBF的一些分析。 -------------------------------------------------- ----------------------------别忘了回复，给予kudo并接受为解决方案--------- -------------------------------------------------- ------------------- |
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谢谢Venkata。
这是一个很难的要求吗？ 它可能是ASIC实现的交易破坏者，因为如果我们必须在时钟域上进行七级同步，那么FPGA将与ASIC非常不同。 这对我的客户usgae模型来说是一个问题。 使用2阶段同步会产生什么后果？ 有任何变通方法吗？ |
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