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Hiya -
尝试简单地向FRAME_ECC2块的ram数组中注入错误以检测SEU错误。 不，我不想要SEU控制器的开销; 在Sparta6上，我们对空间非常有限，并且能够通过它的DRP端口重新配置PLL而导致SEU错误。 发现这是我们利用的Spartan6的设计缺陷。 我可以轻松地将SLICE / LUT锁定到设计中的特定位置，然后只需从ICAP2端口读取值，并使用值的补码覆盖它。 问题是，我不知道地址。 这记录在哪里？ 感谢名单....安德鲁 
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5个回答
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一个，
你在7系列主板中提到Spartan 6？ 那是哪个呢？ 不，我们不支持通过SEM IP以外的任何方式摆弄比特。 如果这是你想要做的（翻转位），那么使用它。 如果没有，您将需要对您自己的解决方案进行逆向工程，但不要求我们帮助您：这就是我们开始使用SEM IP的原因（通过个性化解决方案支持成千上万的客户不是解决方案，这是一场灾难）。 如果这是一个研究计划，请发送电子邮件至austin@xilinx.com Xilinx支持大学和研究机构的工作，但是对于像这样的科目; 不在论坛上。 Austin Lesea主要工程师Xilinx San Jose |
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这是在Spartan6上完成的，然后移植到Kintex7。
我只需要破坏阵列。 PLL上的DRP是过去最简单的方法。 我们没有SEM资源的FPGA资源。 什么是宽松的方式？ 是用Verilog / Vhdl编写的SEM IP所以我可以阅读源代码吗？....安德鲁 |
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一个，
我建议您联系您的现场应用工程师寻求帮助，因为您没有SEM IP空间。 您是否尝试验证设置是否正确，设备是否能够使用硬件模式查找和修复扰乱？ 或者，只是发现发生了不安？ Austin Lesea主要工程师Xilinx San Jose |
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奥斯汀 - 试图验证：
1）确实检测到CRC错误。 2）设置/约束是正确的。 3）模具可以校正所公布的单比特错误。 可以使用任何位置/方法。 PCIE是一个机会吗？......安德鲁 |
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一个，
一切公平，必要（或应该）， 同样，由于您没有使用SEM IP，您需要FAE的帮助。 对于所有阅读此内容的人：在许多市场空间（安全，网络，有线，无线......）中，包含SEM IP正在迅速成为一项要求（不是一种选择）。 SEM IP正在由各个机构进行认证，或者已经过认证。 Xilinx进行的广泛测试有助于其作为软错误解决方案的稳健性。 虽然迄今为止7系列具有迄今为止所有FPGA系列中最低的降低率，并且在许多市场中使用最广泛，但软错误仍然是需要解决的问题。 SEM IP核实现了这一点。 没有其他供应商，任何设备（ASSP，ASIC，FPGA，up.SoC）都有解决方案。 当CRC检查时，它确保没有发生损坏，并且逻辑处理的结果是有效的（至少就设计本身可信任而言）。 Austin Lesea主要工程师Xilinx San Jose |
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只有小组成员才能发言，加入小组>>
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