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请参考Artix-7数据表的第6页http://www.xilinx.com/support/documentation/data_sheets/ds181_Artix_7_Data_Sheet.pdf
它描述了Artix-7（7系列）FPGA的所有上电和下电序列要求。 _______________________________________________如果有助于解决您的查询，请将此帖子标记为“接受为解决方案”。 因此，它将有助于其他论坛用户直接参考答案。如果您认为该信息有用且面向答复，请给予此帖子称赞。 |
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在Artix-7数据手册中，它指出推荐的上电顺序是VCCINT，VCCBRAM，VCCAUX和VCCO。
它还指出，为GTP收发器实现最小电流消耗的推荐上电顺序是VCCINT，VMGTAVCC，VMGTAVTT或VMGTAVCC，VCCINT，VMGTAVTT。 VMGTAVCC和VCCINT都可以同时加速。 这些序列是否独立？ 如果两个序列都有效但电压轨同时出现，我可以使用以下序列吗？ 1. VCCINT，VCCBRAM和VMGTAVCC（1V） 2.VMGTAVTT（1.2V）和VCCAUX（1.8V） 3.VCCO（3.3V） 蒂姆 |
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蒂姆
“同一时间”是指至少90％的值在几百微秒内相互实现完全没问题。 数据表代表我们如何测试每个设备（故意序列，每个轨道上明显分开）。 如果你立刻打开电源，那就完全没问题了。 请注意，“立刻”可能会在时间和顺序上有所不同，这可能导致IO在通电时不会处于三态（可能是，但我们没有这样测试）。 同样，上电所需的功率仅在所描述的序列中指定。 它不是一次性的吗？ 更多？ 我们不知道（对于每个部分），因为我们没有测试100％的部件。 可以说我们确实为各种功率序列表征了系列，并且对于所有功率序列，所需的功率名义上与推荐的序列没有区别。 好？ Austin Lesea主要工程师Xilinx San Jose |
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数据手册为您提供了FPGA的序列和收发器的单独序列。
除了Vcco - Vccaux> = 2.625V之外，它没有提供关于每次供应之间的时间的任何信息。 因此，如果我遵循2个序列并确保Vcco - Vccaux> = 2.625V不会发生比Tvcco2vccaux更长的时间，那么FPGA的操作和可靠性应该最大化。 因此，我们应该能够仅使用三个控制信号将FPGA及其收发器上电，这些控制信号将相隔大约10ms。 FPGA序列 收发器序列 启用1 VCCINT＆amp; VCCBRAM（1V） VCCINT＆amp; VMGTAVCC（1V） 启用2 VCCAUX（1.8V） VMGTAVTT（1.2V） 启用3 VCCO（3.3V） 蒂姆 |
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你描述的加电顺序很好。
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只有小组成员才能发言，加入小组>>
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