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大家好,
我想知道是否有可能使用Virtex5 FPGA创建两个输出时钟信号,这样一个时钟信号是另一个时钟信号的精确复制品,但只是在时间上延迟? 如果可能的话,我将采用什么方法来实现这些信号,以及如何将这两个信号输出到实际的硬件设备中,例如示波器? 谢谢。 贾森 |
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