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我在zynq板（zc706）中使用16GB RDIMM。
具体内存名称为MT36JSF2G72PZ-1G6内存。（行：16，col：11，bank：3，双列） 我查看了支持内存部分的xilinx链接。（http://www.xilinx.com/support/answers/54025.html） 但是我找不到与我正在使用的完全相同的内存。 我尝试过使用xilinx mig（内存接口生成器）ip并创建了自定义内存。 在我创建自定义内存部分后，内存详细信息显示为16GB 但合成和实现后记忆细节发生了变化。 （截图附后） 我怎么解决这个问题？ mig是否支持16GBMT36JSF2G72PZ-1G6内存？ 
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5个回答
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@ harding99
你写道：“但是在合成和实现之后内存细节发生了变化。（截图已附上）” 这是第一次还是第二次拍摄？ 在综合和查看GUI中的不同部分后，您是否尝试在项目中自定义MIGIP？ 但它看起来内存部分在两个情况下是不同的，一个是14，另一个是16G1，这是默认情况下还是手动更改？ 我建议将自定义设置为canccel并重新检查还打开顶级文件并验证您的自定义部件设置是否正确传播。 希望这可以帮助 -Vanitha -------------------------------------------------- -------------------------------------------请在发布前进行谷歌搜索， 您可能会找到相关信息。请留下帖子 - “接受为解决方案”，如果提供的信息有用且回复，请给予赞誉 |
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第一个是创建自定义内存部分后立即显示的快照。
第二个是我在生成mig之后可以看到的sanpshot（我认为它在实现之后就已经改变了，但是在生成mig之后它发生了变化（我点击它来检查我是否正确）。 内存部分名称的不同之处在于我刚捕获它以显示它是如何变化的。 我的意思是，我使用不同的名称制作了相同的自定义内存部分。 我已经检查了顶级文件，我的自定义部件设置没有正确传播。 我将COL WIDTH设置为11，但顶层显示COL WIDTH 10。 |
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@ harding99
你可以在这里上传你的压缩项目来检查我的结尾吗？ -------------------------------------------------- -------------------------------------------请在发布前进行谷歌搜索， 您可能会找到相关信息。请留下帖子 - “接受为解决方案”，如果提供的信息有用且回复，请给予赞誉 |
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@ harding99
我能够为ZC706为16G RDIMM生成MIG，我进行了双重检查，并且top leve文件中存在col_width = 11。 我使用了Vivado 2016.1 我还验证了示例设计的网表，并且可以确认正确地传播了col_width = 11。 我已附上我的项目以供参考，请在您的最后检查，如果符合您的要求，您可以更改设备设置（以匹配您的电路板）并使用相同的流程。 虽然地址位是正确的，但是我看到了一个MIG GUI问题，虽然你选择了16G部件，工具在控制器选项页面底部将其称为8G，但我可以提交CR并将其报告给工程师。 希望这可以帮助 -Vanitha -------------------------------------------------- -------------------------------------------请在发布前进行谷歌搜索， 您可能会找到相关信息。请留下帖子 - “接受为解决方案”，如果提供的信息有用且回复，请给予赞誉 ZC706_16G_RDIMM.7z 393 KB |
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