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赛灵思Zynq-7000可扩展处理平台(EPP)将双ARM Cortex-A9 MPCore处理器系统与可编程逻辑和硬IP外设紧密集成在一起，提供了灵活性、可配置性和性能的完美组合。围绕其刚刚推出的可扩展处理平台(EPP)， 赛灵思在今年3月发布了基于Zynq -7000新系列的首批器件。
采用28 nm制造工艺， Zynq-7000嵌入式处理平台系列的每款产品均采用带有NEON及双精度浮点引擎的双核ARM Cortex-A9 MPCore处理系统，该系统通过硬连线完成了包括L1，L2 缓存、存储器控制器以及常用外设在内的全面集成。(图 1)。尽管FPGA厂商此前已推出过带硬核或软核处理器的器件，但Zynq-7000 EPP的独特之处在于它由ARM处理器系统而非可编程逻辑元件来进行控制。也就是说，处理系统能够在开机时引导(在FPGA逻辑之前)并运行各个独立于可编程逻辑之外的操作系统。这样设计人员就可对处理系统进行编程，根据需要来配置可编程逻辑。 
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利用这种方法，软件编程模式将与全功能标准ARM处理器片上系统(SoC)毫无二致。过去设计师需要对FPGA逻辑进行编程以运行片上处理器。那就意味着如果想要使用器件，必须得是FPGA设计师。但现在使用Zynq-7000 EPP，则完全不必担心这一问题。
图1:不同于以往在FPGA架构中嵌入MPU ，赛灵思全新Zynq-7000 EPP系列使用ARM处理器而非可编程逻辑来进行控制。 |
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图中文字：
新产品系列消除了延迟和从头设计芯片的风险，这意味着系统设计团队可以利用其先进的高级软硬件编程多功能性简便快速创建创新型片上系统，而这是其他任何半导体器件都无法实现的。这样，Zynq -7000 EPP能够为广大的创新者带来无法比拟的益处，无论是专业的硬件、软件、系统设计师或仅是单纯的“制造商”，他们都可以探讨处理能力与编程逻辑结合的可能性，进而创建出从未想象过的创新应用。 |
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赛灵思处理平台副总裁Larry Getman表示：“从最根本的层次来说，Zynq-7000 EPP应该算是一类全新的半导体产品。它既不是单纯的处理器，也不是单纯的FPGA。我们的产品是两者的完美结合，正因如此我们才能够帮助您消除现有解决方案的局限性，尤其针对双芯片解决方案和ASIC。
Getman称当前大多数电子系统都是将一个FPGA和一个独立处理器或者一个带有片上处理器的ASIC在同一个PCB上配合使用。赛灵思的最新产品可支持使用这类双芯片解决方案的公司利用一个Zynq-7000芯片来构建下一代系统，节省了物料成本和PCB空间，并且降低了总体功耗预算。由于处理器和FPGA在相同的架构上，因此性能也得到了大幅提升。 Getman表示Zynq-7000 EPP将会加快从ASIC向FPGA的市场迁移。采用最新制造工艺实施ASIC过于昂贵并且对大多数应用来说风险太大。因此，越来越多的公司青睐于FPGA。许多尝试坚守旧ASIC方法的公司采用旧的制造工艺来实施他们的设计，分析师称之为“价值认知型片上系统ASIC”。然而ASIC依旧需要较长的设计周期并且存在重新设计(respin)的风险，这样一来费用将会非常昂贵并且可能还会延迟产品的上市时间。Getman说：“与旧技术相比，借助采用28 nm技术的Zynq-7000 EPP，器件的可编程逻辑部分并不存在尺寸或性能损耗的问题，您还可在处理子系统中获得硬化28 nm片上系统的附加优势。凭借不到15美元的起始售价，我们使设计那些产量并非很大的ASIC在成本和风险上都不再划算。您可以即刻让您的软硬件团队开工，而那些死守ASIC的设计团队就很难做到这一点。” Getman表示自从赛灵思去年推出这款架构以来，市场对Zynq-7000 EPP的兴趣和需求非常强烈。经选择出的一部分早期试用客户(alpha customer)已开始对将使用Zynq-7000器件的系统进行原型设计。该技术非常令人兴奋。” |
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智能架构决策
在赛灵思处理解决方案副总裁Vidya Rajagopalan的领导下，Zynq-7000 EPP设计团队专门针对这类新器件而推出了一款设计精良的架构。除了选择应用广泛且倍受欢迎的ARM处理器系统以外，设计团队的一个重要架构决策是在处理系统和可编程逻辑之间广泛使用高带宽AMBA高级扩展接口(AXI)互联。这样一来便能够以较低的功耗支持ARM双核Cortex-A9 MPCore处理子系统和可编程逻辑之间的多千兆位数据传输，进而消除了控制、数据、I/O 和内存所面临的性能瓶颈。 实际上，赛灵思一直与ARM保持紧密合作，力求让ARM架构更加适合于FPGA应用。Rajagopalan称：“AXI4拥有存储器访问版本和流数据访问版本。赛灵思推动着ARM的流定义，因为人们针对应用而开发的许多IP (例如高带宽视频)均为流IP。ARM的产品没有这种流接口，因此他们选择与我们合作。” Getman称这款架构的另一个主要方面是赛灵思将一组有益的标准接口IP硬化到Zynq-7000 EPP芯片中。他说：“我们尽量选择应用更广泛的外设，例如USB、以太网、SDIO、UART、SPI、I2C和GPIO都是标准配置。但有一个例外，那就是我们还向该器件添加了CAN。CAN属于稍专业化的硬化核心之一，但它在以下两个主要目标市场中应用广泛：工业和汽车业。将其硬化在器件中只是Zynq-7000 EPP的又一个卖点。 在内存方面，Zynq-7000器件提供了多达512 KB的二级缓存，由两个处理器共享。Getman说：“Zynq-7000 EPP器件具有256 KB的高速暂存区，这是处理器和FPGA都可以访问的共享内存。” 一个单独的多标准DDR控制器可支持三种类型的双倍数据速率内存。 Rajagopalan表示：“大多数ASSP的目标是特定细分市场，而我们的目标是LP DDR2、DDR2和DDR3，因此用户可以根据自身需求在功率和性能之间做出权衡。这是一种多标准DDR控制器，而我们是最早提供类似控制器的公司之一。” Zynq-7000 EPP不仅是一种新器件，也是赛灵思的最新设计平台， 它与开发板、软件、IP和文档一起提供，可以帮助客户迅速上手和运行。此外，赛灵思还将在未来几年中不断推出针对特定垂直市场和特定应用的 Zynq-7000 EPP 设计平台(包括板卡或子卡、IP 和文档)，以帮助设计团队加快产品上市速度(请参阅《Xcell 期刊》第68期封面故事，http://www.xilinx.com/pub-lications/archives/xcell/Xcell68.pdf)。 赛灵思联盟计划成员和ARM联盟也将为客户提供丰富的Zynq-7000 EPP资源，包括主流操作系统、调试程序、IP、参考设计及其它学习和开发资料等。 除了创造出色的芯片和配套工具，赛灵思还为Zynq-7000 EPP精心提供了简单易用的设计和编程流程。 |
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