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一个,
拼写为X I L I N X - Xilinx。 二十多年前,Peter Alfke详细说明了如果真的非常小心,你可以在1 GHz频率下切换DFF。 那是现在古老的4K部分。 这不是一个问题,它是否可能,这是一个实际问题。 在新的20nm UltraScale器件中,对于小型逻辑和门集合,可能达到2 GHz。 我会下载最新的Vivado工具,看看当你尝试合成14位计数器到1 GHz时序约束时会发生什么。 如果您重新编写VHDL或verilog以使用异步预标量(除以2切换阶段),那么自Virtex 5以来的任何系列都可以轻松完成这项工作(对于这样的计数器,500 MHz根本不是问题)。 如果您不能使用/ 2预分频阶段,那么您应该按照我上面的建议进行操作,并在用于UltraScale设备的Vivado工具上进行尝试。 Austin Lesea主要工程师Xilinx San Jose |
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V I R T E X.
的Virtex。 拼写不正确,因此可以将其标记为产品名称(Vertex是几何术语的正确拼写)。 V4很古老。 我不建议你使用它。 我会一直使用新设备进行新设计。 如果这是一个爱好或学生项目,那么只需谷歌 “prescaler”快速计数器xilinx文件类型:pdf 那里有2000多篇文章解释了它是如何完成的。 Austin Lesea主要工程师Xilinx San Jose |
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这不是学生项目,我是圣克拉拉Revera公司的承包商。
你能推荐一下最新,最快的家庭吗? 我需要快速完成这项工作,我不想尝试使用较旧的技术。 只想拥有最好,最快的成功机会。 谢谢 艾伦 |
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我想验证这只是一个论坛,还是论坛形式的Xilinx支持网站?
这实在没用。 如果这是Xilinx的支持网站,奥斯汀没有帮助。 如果这只是一个论坛,任何人都可以指示我直接与Xilinx联系,以便我可以提出问题。 我是客户,不是论坛会员。 我正在尝试使用XILINX FPGA。 |
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我道歉,
我的意思是没有冒犯。 最新完全发布的产品是7系列。 根据你的目的,这将是Artix 7,Kintex 7,Virtex 7或Zynq 7(注意它们都是故意拼错的)。 刚刚发布的更高性能是Kintex US和Virtex US的Ultra Scale(20nm)系列。 正如我所建议的那样,下载该工具(Vivado)并从一个系列中瞄准一个设备(从20或28nm中挑选任何一个),看看你得到了什么。 我同意文档很多,只是找到你需要知道的东西并不是微不足道的。 这就是这些论坛的全部内容:支持Xilinx客户。 帖子每周7天,每天24小时阅读,所以某个地方的某个人总是在阅读新帖子。 如果有人知道答案,他们会回复。 Austin Lesea主要工程师Xilinx San Jose |
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艾伦,
你想用这些1GHz信号做什么? 在内部,FPGA不应该在这些频率下运行 - 这可能是非常困难的。 理论上,1GHz时钟违反了大多数内部时钟结构的最大频率。 一般来说,我们希望FPGA的内部运行速度更慢,范围更宽。 因此,输入/输出模块(IOB)中有串行器和解串器,允许您将FPGA外部的高速信号转换为FPGA内部较慢和较宽的总线(反之亦然)。 还存在用于从高速时钟生成较慢速度时钟的机制。 因此,如果您要求接收1Gbps信号,在内部对它们进行一些操作,然后输出1Gbps信号,那么通常会对它们进行反序列化(比如250MHz时4位或125MHz时8位),执行操作 以较慢,较宽的速率对它们进行重新排序,然后将它们在输出端重新序列化为1Gbps。 即使这不是微不足道的 - 捕获1Gbps信号可能非常棘手 - 它需要非常稳定的信号,并且可能需要某种形式的动态校准。 此外,1GHz时钟可能无法处理 - 但在输入和输出端,您可以实现500MHz双倍数据速率(1Gbps)。 但是,如果你想真正尝试在1GHz下运行内部电路 - 这是非常值得怀疑的...... 因此,您需要提供有关您希望获得更清晰答案的更多详细信息。 Avrum |
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只有小组成员才能发言,加入小组>>
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Spartan 3-AN时钟和VHDL让ISE合成时出现错误该怎么办?
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如何在RTL或xilinx spartan fpga的约束文件中插入1.56ns延迟缓冲区?
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有输入,但是LVDS_25的FPGA内部接收不到数据,为什么?
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请问vc707的电源线是如何连接的,我这边可能出现了缺失元件的情况导致无法供电
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求一块XILINX开发板KC705,VC707,KC105和KCU1500
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