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我正在为kintex 7 325T-FFG676设备设计原理图。
在我的设计中,一些ADC提供10位并行LVDS输出,其电压电平如下: 逻辑低= 1.075 V. 逻辑高= 1.375 V. 差分输出= 350 mV 共模= 1.25 V. 我需要将这些引脚连接到FPGA。 我想将FPGA内部差分终端用于输入。 我的问题是: 1)我应该将引脚连接到HP或HR库吗? 2)连接到ADC的银行的Vcco值应该是多少? 3)多个bank的Vcco引脚可以连接到不同的电压吗? 像银行12 Vcco连接到1.8 V和银行13 Vcco连接到2.5伏? 谢谢。 |
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2个回答
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你可以从表13中给出的数据表中查看kintex-7的lvds规格
http://www.xilinx.com/support/documentation/data_sheets/ds182_Kintex_7_Data_Sheet.pdf 比较规格,看看它们是否合适。 lvds可在HP银行获得,而lvds_25可在HR银行获得。 有关selectIO用户指南的此检查的更多详细信息 http://www.xilinx.com/support/documentation/user_guides/ug471_7Series_SelectIO.pdf |
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1)LVDS不依赖于VCCO(在源或目标处)。
即使使用1.5V VCCO,HR bank也可以支持LVDS,但带有外部终端电阻。 2)您只需要确保在您使用的VCCO电压下支持LVDS。 对于某些存储体,LVDS仅在某些电压下受支持,因此请检查特定存储体并确保将VCCO设置为支持LVDS的电压(即有时,Bank仅支持LVDS_25而不支持LVDS为1.8V)3)是的,不同的存储体可以是 连接到VCCO的不同电压。 您需要确保连接到这些存储体的外设生成和/或接受相同电压的信号。 - 如果提供的信息有用,请将答案标记为“接受为解决方案”。给予您认为有用且回复的帖子。 |
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