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嗨,
我试图使用Chipscope Pro来调试我的FPGA(Spartan 6:SP605)实现。 我想在顶层模块放置一个ILA和一个VIO核心,在子级别模块放置一个ILA和一个VIO。 设计Hirarchy TOP -------------------(ILA和VIO) | | - A1 | - B1 | - C1 | | --- C2 ----------(ILA和VIO) (1)我需要在哪里实例化ICON核心? (2)我需要多少个ICON核心? (3)ICON core / s和ILA / VIO core / s之间如何连接“控制”信号? 感谢您帮助回答这些问题。我们将非常感谢您提供任何文档/教程/应用说明。 -Hardik |
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2个回答
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你好
请参阅下面的文档 http://www.xilinx.com/support/documentation/sw_manuals/xilinx14_3/ug750.pdf http://www.xilinx.com/support/documentation/sw_manuals/xilinx14_1/PlanAhead_Tutorial_Debugging_w_ChipScope.pdf http://www.xilinx.com/itp/xilinx10/isehelp/ise_c_process_analyze_design_using_chipscope.htm http://www.xilinx.com/support/documentation/sw_manuals/xilinx14_1/chipscope_pro_sw_cores_ug029.pdf 问候,萨蒂什----------------------------------------------- --- --------------------------------------------请注意 - 如果提供的信息有用,请将答案标记为“接受为解决方案”。给予您认为有用的帖子。感谢.-- ---------------------------- --------------------- ---------------------- 在原帖中查看解决方案 |
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你好
请参阅下面的文档 http://www.xilinx.com/support/documentation/sw_manuals/xilinx14_3/ug750.pdf http://www.xilinx.com/support/documentation/sw_manuals/xilinx14_1/PlanAhead_Tutorial_Debugging_w_ChipScope.pdf http://www.xilinx.com/itp/xilinx10/isehelp/ise_c_process_analyze_design_using_chipscope.htm http://www.xilinx.com/support/documentation/sw_manuals/xilinx14_1/chipscope_pro_sw_cores_ug029.pdf 问候,萨蒂什----------------------------------------------- --- --------------------------------------------请注意 - 如果提供的信息有用,请将答案标记为“接受为解决方案”。给予您认为有用的帖子。感谢.-- ---------------------------- --------------------- ---------------------- |
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