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电子发烧友论坛|
大家好。
我遇到了xilinx视频内核的问题，并试图解决这个问题好几周但都失败了。 有人能给我一些关于AXI4-Stream到Video核心的技巧吗？ 我试图在我的项目中实现Video Scaler核心，这是一个由数据视频生成器卡携带的模块。 在这种情况下，我只使用了四个内核来实现简单设计，即（1）。 视频输入到Axi4-Stream核心，（2）视频缩放器核心，（3）。 AXI4-Stream到Video Out核心，以及（4）VTC核心实现为（1）的检测器和（3）的生成器。 问题是，如果我将Video Scaler内核放入我的设计中，AXI4-Stream to Video Out（ASVO）内核的所有输出（video_data，Vsync，Hsync，video_de）在模拟中始终保持0。 但是，我从我的项目中删除了Video Scaler核心，在锁定信号被断言后，我得到了ASVO核心的所有输出。 当我移除ASVO核心时，我还尝试使用Video-In到Axi4-Stream核心（VIAS）测试Video Scaler核心。 视频流也可以通过这两个核心。 正如我上面所说，我使用了两个VTC核心。 一个连接到VIAS核心作为检测器，另一个连接到ASVO核心作为发生器。 我确信我能正确地连接所有端口。 所见的是ModelSim的波形视图，我发现fifo_rst信号总是在一帧之后被断言。 我不确定它是如何工作的。 谁能帮助我？ 非常感谢你。 问候，伍迪 
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6个回答
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嗨，
我认为你需要为VTC运行最少2帧的同步输出，请运行很长时间或检查硬件？ 问候， Vanitha。 -------------------------------------------------- -------------------------------------------请在发布前进行谷歌搜索， 您可能会找到相关信息。请留下帖子 - “接受为解决方案”，如果提供的信息有用且回复，请给予赞誉 |
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奥斯汀写道：
始终处于重置状态意味着您的重置逻辑中存在错误。 找到错误，修复错误。 谢谢奥斯汀。 也许我说的不清楚。 fifo_rst信号由Axi4流声明到视频输出核心。问题是如果我用视频缩放器核心测试我的设计，fifo_rst将每三帧断言一次。 但是，如果我删除了视频缩放器，则fifo_rst信号仅在第二帧处断言，并且核心正常工作。 在这种情况下，我认为这里没有错误。 我只是认为它可能是由未知问题引起的。 我的设计有问题吗？ 在其他工作中，这三个核心可以连接在一起，对吗？ 谢谢。 伍迪 问候，伍迪 |
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vsrunga写道：
嗨， 我认为你需要为VTC运行最少2帧的同步输出，请运行很长时间或检查硬件？ 问候， Vanitha。 谢谢，Vanitha。 我确实运行了超过10帧的模拟，但我什么也没得到。 在我删除视频缩放器核心的测试中，我只是在三帧之后得到结果。 我不确定视频缩放器的输出是否可以作为输入连接到Axi-S到视频输出核心。 问候， 伍迪 问候，伍迪 |
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嗨！哥们儿
你解决了这个问题吗？ 也许我们都处于相同的bug状态。 这是我关于这个问题的主题。 http://forums.xilinx.com/t5/General-Technical-Discussion/The-axi4s-vid-out-TRD-project/td-p/373771 |
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你好，亲爱的朋友，你现在解决了问题吗？
Imay遇到了类似的问题。在我的设计中，有些输出是正常的，比如tvalid，tlast，tuser，但是tdata总是保持0，我检查了tready输入，它始终是1.我不知道为什么。 如果您已经解决了问题，可以与我分享您的经验吗？ 非常感谢你 ！ 我的电子邮件地址458868525@qq.com |
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