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你好,
在我的FX3固件,我们有一个问题从奴隶FIFO数据的正确性。我们认为,数据正确性问题的原因是PC没有足够快地启动传输。因此,我们想想象一下,我们得到了USB传输的时间,并与FPASGISIONS进行比较。 因此,当USB数据包到达FX3时,我想切换IO引脚。然后,我可以触发该信号,并确定在USB到达时间和FPGA数据到达之间的时间。 或者有更好的方法来做这件事吗? 我们有128个X 1024缓冲器,配置为THEAD0与USB端点0x82DMA通道之间的DMA通道。FPGA有2KB FIFO。当我们从PC读取数据时,我们可以看到,一旦我们得到130kb(128kb+2kb的FPGA缓冲区),我们就会丢失一些数据。之后,在该传输中接收的其余数据是正确的。 例如: 如果在PC端使用XFEDATA函数读取10MB的数据。第一130kb的缓冲区是正确的。然后我们丢失一些数据。之后,其余10MB数据是正确的。 我们认为,这是因为即使我们在PC中调用XFEDATA函数,也需要相当长的时间来到达FX3的IN传输。正因为如此,FPGA FIFO溢出了。 请让我知道当转移到FX3时可视化的方式。 谢谢您。 |
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2个回答
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你使用了多少个缓冲区?你使用的是一个128 K的缓冲区吗?你能为此创建一个技术支持案例吗?
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我使用128个缓冲区,每个都有1024BytSin。
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请问可以直接使用来自FX2LP固件的端点向主机FIFO写入数据吗?
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