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电子发烧友论坛|
大家好，
我试图配置使用低的信号来自一个ADC delsig 100Hz截止滤光片。遗憾的是，我没有得到预期的结果。有没有一些配置过滤器块的例子？ PS：我知道信号来自是ADC（通过DMA）是正确的因为我已经测试过它。 滤波器组ADCYVDAC01.BuffLe01.ZIP 3.7兆字节 
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31个回答
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然而，当频率为15Hz时，频率是多少？？？？ADC当然可以与直流信号。
你看我用DMA有点不同，你 CydMatdSt配置（DMAY1YTD〔0〕，1U，DMAIN VALIDIDYTD，DMAY1YA TdTyMutOUTHEN）； 据我所知，dma_invalid_td意味着当TD完成渠道完成（没有下TD）必须重新开始。我建议你在一个循环中使用Dame TD，因此 cydmatdsetconfiguration（dma_1_td [ 0 ]，1U，dma_1_td [ 0 ]，dma_1__td_termout_en）； 同样适用于其他的DMA通道。 你应该缓冲ADC参考。 为了补偿补偿你应该考虑使用外部参考电压连接到OpAmp和先证者的身体。 鲍勃 |
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使用交流信号的ADC转换器，我看不出任何问题。
这个项目的主要结构，我从PSoC Creator的例子，包括DMA配置。为了包含DMAI1（第二个DMA块）配置，我使用了来自PSoC Creator的DMA向导。我会看看这些配置，但我没有太多的知识。 你能举一些关于缓冲的ADC参考的例子吗？对我来说还不太清楚。 丹尼尔。 |
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好啊。所以首先我必须设置为差分模式。然后，我必须将VREF配置到P0（3）或P3（2）PIN外部。之后，我必须将电容器连接到这个引脚和地上。所有其他配置，我已经离开了。对吗？
我上传了一个我从创建者的例子中得到的图像。你能确认他们在ADC上使用相同的缓冲器原理吗？（我不理解所有的例子） PNG 234.7 K |
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这张图片来自于创建者的FieldAdCyVDAC示例。我会上传这个项目。
我已经看过ADC Delsig数据表，但我怀疑何时使用每个配置。 假设P0O3选择了理想的VREF＝GND。那我可以把P03连接到Gnd吗？（考虑旁路电容器已经安装在P0O3上）。使您所说的与设置VREF＝VSS（内部Gnd）不同？ 滤波器组ADCYVDAC01.BuffLe01.ZIP 326 K |
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当我谈到Vref和GND时，我说的是OpAmp，而不是ADC。我的意思是
配置运算放大器作为第二输入。 不要把Gnd绑起来！！！！这是内部VREF冲到一个引脚使它稳定。 当你使用CY8CKIT-059时，已经有一个1μF的上限连接到P03！ 鲍勃 滤光器0.JPG 207.4 K |
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好的，当我看到过滤器的时候，事情就变得非常清楚了。我想我知道了主要的想法。现在我来试试你说的这些技巧。如果电路仍然没有预期的反应我会要求更多的帮助。谢谢你的帮助！
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我做了一些测试，我发现我得到了错误的答案。我只放置了PGA，当信号（带偏移）的频率为20赫兹时，输出比预期的要低得多（增益＝4，VIN＝100mV，VOUT＝400毫伏）。我只尝试了VREF＝VSS（内部），但我认为即使在这种配置中，它也应该工作。有人有暗示吗？
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在你的100mv来自究竟你在输出引脚的措施？你的测量装置是什么？范围？万用表？
事实是，在PSoC PGA通常工作很好，没有任何已知的问题。 你能画一个地图输入电压与输出电压吗？ 鲍勃 |
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我按照你说的上传了我的项目。我只是期待一个简单的低通滤波器。我配置为第四个订单，但它可以是第一个订单。截止配置为100赫兹。您可以在我上传的项目中看到ADC的所有配置。 |
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我会考虑将SysCLK频率增加到60MHz，这会给中断处理程序带来更多的处理器时间。每秒10K中断@只有24MHz可能有点困难。
另外，我建议使用第四或第六阶滤波器。 鲍勃 |
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只有小组成员才能发言，加入小组>>
786个成员聚集在这个小组
加入小组cyUSB3014一直显示2.1，不能到3.0情况，谁遇到过
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