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大家好
我已经从PSoC Creator 3.1 SP3更新到PSoc Creator 3。 我很难用前一个版本的创建者创建项目。 可能是我不理解下面的信息，每当我打开任何项目。 发现了以下新的系统级组件：Link动态。设计范围广泛的资源文件“Projtual.CydWR”存储这些组件的选定版本。新发现的组件版本需要保存，因此如果新版本的组件可用，它们将不会自动更新到最新版本。 意味着什么？ 非常感谢你 
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14个回答
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谢谢你，鲍伯！
我正在使用CY8C38 66 LTI。 请参阅附图从一个非常简单的项目。 请让我知道为什么它没有显示高名称组件引脚的PIN名称。 唯一的方法是在PIN组件配置框上设置“毗连”，但这样做时，项目不会编译。 非常感谢。 日本国防军 121.9 K Cyrrkk.Access 03.Zip 1.9兆字节 |
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嗨，鲍伯，每当有创建者的更新时，我就遇到麻烦了。
正如我告诉你的，我正在工作CY8C38 66 LTi030。 我在DWR调试选择设置为GPIO，因为我需要大部分的P1.PoT引脚。 我这样做没有问题，编译或下载代码的PSoC 3。 我用一powerfulboard因为有一个小巧的外形和方便的测试项目。 我打算制造印制电路板。 它确实意味着已经完成了PIN任务。 我要建立一个引脚配置，工作总是可以从原型开始大麻烦。 请看附件的PDF在我解释发生了什么。 另一方面，现在，我只是一个项目从编制整个工作空间和编译器给我其他的项目，不设置为活动项目的错误。 这不是一个问题与代码是关于造物主的配置变化。 请帮帮我。 最好的问候， 端口问题- PIN协议 364.8 K |
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工作空间不完整，我不能打开10x15项目。在另一个项目中，端口是连续的，并且它编译得很好。
一个问题：为什么你想让你的PIN驻留在同一个端口（这是连续的意思）-你可以为你的I/OS指定任何*PIN位置。 我看不到（或重现）你的问题。 鲍勃 |
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鲍伯请看附件10x15项目。
这个项目是读一个15科隆数组10行。 我一直在PSOC创建者的版本之前工作，并且正在工作。 连续的意思是关于更容易阅读的数组。 我正在移动一个“逻辑1”，然后我在阅读每一行。 在我看来，这个过程需要连续的PIN。 但是，也要查看模拟端口，它在端口0中包含整个位。 为什么我不能把整个端口设置为连续体？在那之前行动是可能的。 我将尝试为每个项目建立一个新的示意图，换言之，我将生成一个新的工作区。 10x15Alay-txrx.Cyrjj.Access 01.Zip 2兆字节 |
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鲍伯请看附件10x15项目。
这个项目是读一个15科隆数组10行。 我一直在PSOC创建者的版本之前工作，并且正在工作。 连续的意思是关于更容易阅读的数组。 我正在移动一个“逻辑1”，然后我在阅读每一行。 在我看来，这个过程需要连续的PIN。 但是，也要查看模拟端口，它在端口0中包含整个位。 为什么我不能把整个端口设置为连续体？在那之前行动是可能的。 我将尝试为每个项目建立一个新的示意图，换言之，我将生成一个新的工作区。 10x15Alay-txrx.Cyrjj.Access 01.Zip 2兆字节 |
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由于您使用的是控制寄存器来设置引脚，所以不管您是否使用连续的引脚，都是完全不相关的。
同样的模拟输入引脚。 相邻的引脚都驻留在同一端口，不允许模拟引脚。 在HythoCL上使用来自不同端口的PIN，这样就不行了。 类比PORT1是模拟的，所以也不工作，但是你可以将你的Apple Posi1和PoT2结合到一个单一的组件中，并输入所需的数量。当你使用一些“显示为总线”的特性时，你可以在不改变逻辑的情况下清理你的纸张。 在您的LoLoCo管脚上，您可以放弃控制寄存器，设置为没有硬件连接，并用单个语句写入。 LoWixCull写（位模式）； 所有毗连端口引脚的输出。 鲍勃 |
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