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嗨，大家好，
我使用的是创建者3.3和4M目标（CY8C4247Lti-M475）。在新时钟组件（只有HFCLK）中，我没有选择使用LFCK作为源，并且当我使用“现有的”并连接到LFCLK时，适当地抱怨计数器时钟输入需要连接到一个时钟域信号。 我觉得这可能是我错过的非常愚蠢的事情，但是有人知道怎么做吗？ 最后，我试着在深睡眠时对输入引脚进行计数。我想还有其他的方法来做，但是奇怪的是，我不能得到LFCK的示意性访问。 安东尼 
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8个回答
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希安东尼
我一直在试着在我的PSoC4BLE中设置LFCLKTO定时器，但我不能这样做……这是个问题，因为在DEEPSLEEPHFCLK关机，所以我不能把我的IC在很长一段时间内沉睡。 我希望有人能给我们一个答案 |
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看一看这个线程，尝试建议路由LFCK到
一个引脚，然后实例化一个外部时钟… HTTP://www. CyPress .COM/FUMU/PROCE-BUL/AD-LFCLK深度睡眠模式 还注意睡眠表（2）张贴以及线程。 问候，Dana。 |
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这里是一个代表性的解决方案，见附件。
HTTP://wwwyCyp.com /Bog/PSOC-SENSEI-BUGG/USEN-CROPS-PSOC-4 注意在深睡眠UDB计数器将不运行。 问候，Dana。 PSoC 4 LFCLK到UDb0.0.jPG 46.3 K |
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谢谢大家的回复，
外部引脚路由的示意图并不完全是什么，LFCLK应该路由到计数器的时钟，而不是计数输入。无论如何，我现在可以看到，UDB块只保留，而不是操作，在深度睡眠中，因此可能不得不通过中断实现固件。 安东尼 |
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2019-9-20 10:45:45
评论
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UDB计数器的时钟输入是计数输入的同步时钟。
从数据表- 时钟的功能行为的时钟输入不同于固定功能计数器相比于UDB计数器。 对于固定函数计数器，没有计数输入。在时钟输入的每一个上升沿上，固定函数计数器更新（递减其内部计数器）。 对于一个UDB计数器，时钟和计数输入都出现在计数器符号上。时钟用于对计数器组件的输入进行采样。udb计数器作为一个同步计数器使用时钟输入仅作为同步时钟的实现。所有输入的计数器必须同步时钟输入以避免安装违规。这也保证了边缘检测电路在udb计数器的实现功能正常。 在一个固定的功能计数器的计数，在计数输入计数器符号没有。在每一个时钟的上升沿输入FF计数器内部计数更新。对于UDB计数器，计数器更新其内部的计数器与边缘检测的逻辑来确定更新事件。为更新事件源信号取决于udb计数器的时钟模式。边缘检测逻辑使用时钟输入计时。计数输入的边缘必须设置时钟输入；因此，最大的计数输入的时钟输入频率的一半。 在计数器或计数器时钟模式中的计数器，边缘检测逻辑检测计数输入的同步时钟输入的上升沿。根据计数器是否配置为计数器或计数器，边缘检测事件的计数输入递增或递减计数器，分别。图五25页的向上/向下计数器的功能描述。 在计数时钟输入和方向模式udb计数器，边缘检测逻辑检测计数输入的同步时钟输入的上升沿。根据是否“upndown”信号是1或0，边缘检测事件的计数输入递增或递减计数器，分别。见图7 26页的计数输入和方向时钟模式计数器的功能描述。 在upcnt &时钟udb计数器；dwncnt时钟模式，没有计数输入。计数器更新事件是通过边缘检测逻辑确定UpCnt和dwncnt信号同步的时钟输入。见图9 28页在upcnt &时钟计数器的功能描述；dwncnt时钟模式。 问候，Dana。 |
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213123d 发表于 2019-9-20 09:39 这已经晚了，但我们正在努力实现同样的事情。一种可能的解决方案是使用WDT计时器（从CydWR页面中的时钟标签），并将该模式设置为“定期计时器”。你是如何实现的？ |
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