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嗨，
我正在为KC705开发一个定制的FMC子板， 我正在使用AD9772a（模拟器件DAC），DAC所需的数据电平是LVTTL 3.3V，所以我将VADJ设置为3.3V。 为了使数据与时钟同步，DAC输出一个时钟信号（3.3V，80MHZ-100MHz，SIngle Ended），必须将其馈送到FPGA thro FMC连接器。 我们计划使用一个sigle结束差分转换IC（ADN4663。），但这个IC（ADN4663）的输出是LVDS25，因为我使VADJ = 3.3V，是否可以通过FMC连接器使LVDS25？ 
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5个回答
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有关输入和输出的LVDS_25 VCCo要求，请参阅选择用户指南中的表1-55。
http://www.xilinx.com/support/documentation/user_guides/ug471_7Series_SelectIO.pdf 你需要特别注意这个表的注释1，并在vcco不是2.5v时提供lvds_25输入。 --Krishna 在原帖中查看解决方案 |
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有关输入和输出的LVDS_25 VCCo要求，请参阅选择用户指南中的表1-55。
http://www.xilinx.com/support/documentation/user_guides/ug471_7Series_SelectIO.pdf 你需要特别注意这个表的注释1，并在vcco不是2.5v时提供lvds_25输入。 --Krishna |
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首先，LVDS的共模电压为1.2V，无论Vcco为其供电。
因此，板级的实际信号只是LVDS，而不是LVDS_25或LVDS_33。 任何具有不同电源电压的芯片组合都可以使用LVDS标准进行互操作。 重要的是FPGA使用的标准与提供给该组的实际电压相匹配。 这与LVCMOS非常不同，LVCMOS从轨到轨驱动，因此取决于bank电压。 LVDS接收器基本上是差分电压比较器，设计工作在1.2V附近，但通常可以处理更大的共模电压范围。 对于Xilinx器件，您需要确保LVDS输入的整体摆幅不包括正电压轨或接地。 否则，您将激活钳位二极管。 根据您使用的部件，LVDS接收器可由Vcco或Vccaux供电。 然而输入钳位二极管总是转到Vcco。 因此，在由Vccaux供电的LVDS接收器的一部分中，您可以有许多不同的Vcco，但不是例如1.2V，这将钳位信号摆幅的正半部分。 另请注意，某些系列需要特定的Vcco存储区才能为差分输入端接器供电。 - Gabor |
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感谢Gabor的建议。
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只有小组成员才能发言，加入小组>>
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