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它出现在我的脑海中,可能是因为xilinx参考设计页面的混乱。
该页面显示3an设备的ucf文件,该文件具有16位地址空间。(32MB) 但在同一页面上的其他项目中有8位数据页面(不同内存 - 4MB) 有谁知道如何修改启动项目以恢复原始内容,并适当适合3an startap板。 |
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只有小组成员才能发言,加入小组>>
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Spartan 3-AN时钟和VHDL让ISE合成时出现错误该怎么办?
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如何在RTL或xilinx spartan fpga的约束文件中插入1.56ns延迟缓冲区?
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请问vc707的电源线是如何连接的,我这边可能出现了缺失元件的情况导致无法供电
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求一块XILINX开发板KC705,VC707,KC105和KCU1500
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