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大家好，我想使用IO时钟接口对输入中的串行信号进行过采样。
然后，该信号将由vhdl编程逻辑与全局时钟一起使用。 我希望使用IO时钟以更高的频率对这些输入数据进行采样，而不是全局时钟提供的数据，但我找不到任何关于如何设置IO时钟接口的VHDL示例。我读过的文档是GB382， UG380和UG381。请引导我抛出我可能错过的任何文档或VHDL示例。 我正在使用斯巴达6速度-2。 非常感谢你的帮助！ 
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2个回答
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你能提供更多细节吗，比如你想要运行的时钟速度，数据流的序列化因子，接口的宽度？
时钟和数据的关系？ -------------------------------------------------- -----------------------不要忘记回答，kudo，并接受为解决方案.------------- -------------------------------------------------- ---------- |
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感谢您的回答。我希望对输入位进行采样，这些位在一个引脚上串行到达，并由VHDL中描述的UART处理，频率为500MHz。
由于我设置的参数我不能用全局时钟超过40MHz，我想用i4时钟驱动全局时钟，似乎有可能但是我找不到任何关于它的代码。 |
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只有小组成员才能发言，加入小组>>
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