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在XEM6001中,以下引脚在JP2连接器上复用。
针脚22:F2 / GCLKPin 23:F1 / GCLK 我想用它们作为输入。 我已经将它们定义为HDL代码中的输入,但现在我必须在UCF文件中定义它们。 如果我必须在UCF中包含以下行中的任何错误,请告诉我。 NET“adc_data”LOC =“F2”| pulldown; NET“adc_data”LOC =“F1”| 拉下; 我是否需要做更多的事情来断开GCLK与Pin 22和Pin 23的连接? |
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2个回答
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您是否正在使用此板http://assets00.opalkelly.com/library/XEM6001-UM.pdf在您的设计案例时钟中,您必须添加时钟引脚以及ucf F1 / F2引脚应连接到ADC输出
将为您的FPGA设计输入 谢谢和RegardsBalkrishan ----------------------------------------------- ---------------------------------------------请将帖子标记为 一个答案“接受为解决方案”,以防它有助于解决您的查询。如果一个帖子引导到解决方案,请给予赞誉。 |
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@expertengr F1&
F2引脚可连接到全局时钟缓冲器,可用作I / O引脚或时钟输入引脚(GCLK)。 如果不将它们用于时钟输入,它们可以用作常规I / O. 没有必要断开连接,即没有选项。关于UCF,您使用的IO标准是什么? 如果使用LVCMOS33 IO标准,例如,您的UCF可以如下所示 NET“adc_data”LOC =“F2”| IOSTANDARD = LVCMOS33 | 拉下; -------------------------------------------------- -------------------------------------------------- ----------------没有一个愚蠢的问题。 随意问,但快速搜索,以确保它还没有得到解答。 保持对话,获得Kudos和Accept Solution。 -------------------------------------------------- -------------------------------------------------- ------------------- |
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只有小组成员才能发言,加入小组>>
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