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在我的综合结束时,我看到了时序摘要信息,我想知道这是多么准确?
我需要我的电路以100MHz运行,但很快我发现我的电路报告的时间越来越长。 在这种情况下,我已经注释掉了两个关键电路,看看我是否可以将周期恢复到10ns或更低(我做了。) 这份报告与FPGA中的情况相比有多准确,我需要多长时间才能看到这些数字? 此外,如果我发现时间有所上升,我应该做些什么来试图让它保持下来? 谢谢, 马修 时序摘要:---------------速度等级:-4最小周期:9.570ns(最大频率:104.493MHz)时钟前的最小输入到达时间:4.610ns时钟后的最大输出所需时间 :4.310ns最大组合路径延迟:未找到路径======================================= ==================================流程“综合”成功完成 |
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