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作为主题的状态，我感兴趣的是改变我的PSO55LP开发板上的24 MHz晶体和18.5 MHz晶体。这会给我带来什么问题，还是我可以换掉？
以上来自于百度翻译 以下为原文 As the subject states, I am interested in changing the 24 MHz crystal on my PSoC5LP development board to and 18.5 MHz crystal. Will this cause me any problems or can I just swap it and go? 
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2个回答
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USB需要在PSoC上48兆赫，为什么使用24兆赫×2。
如果需要另一个频率，请考虑分数为4的PSoC。 时钟分频器，或使用Verilog生成一个分频器到Gen 18.5兆赫。注意这些技术的缺点是时钟抖动。 以及绝对精度，由于该技术的有限分辨率。 HTTP://www. CyPress？COM/？Id＝2401讨论在页面的下半部分 谷歌“Verilog分数时钟除法器”，你会得到很多点击。 问候，Dana。 以上来自于百度翻译 以下为原文 USB needs 48 Mhz on PSOC, why 24 Mhz is used X 2. If you need another frequency consider PSOC 4 which has fractional clock dividers, or using verilog to generate a fractional divider to gen the 18.5 Mhz. Note the downside is clock jitter in these techniques. As well as absolute accuracy due to finite resolution of the technique. http://www.cypress.com/?id=2401 Discussion half way down the page Google "verilog fractional clock dividers", you will get a lot of hits. Regards, Dana. |
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另一种方法，使用PSoC实现的PLL乘法器，
附上一些基本信息。 问候，Dana。 DeYSTIFFIN -PLPL.PDF 1兆字节 以上来自于百度翻译 以下为原文 Another approach, use a PSOC implemted PLL multiplier, attached some basic info. Regards, Dana.
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