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[tr]创龙的工程师,你好,我遇到一个问题,我用OMAP-L138的EMIFA接了一个FPGA,地址线是A1-A6,数据线是D0-D15,FPGA执行的是简单的译码工作,然后我在DSP端初始化EMIFA的地址线。数据线,读写线管脚,EMIFA初始化为16位的数据线,CS4等工作,参考的是你们给的代码。然后我就开始写while(1 ) {(*((volatile unsigned int *)0x64000120))=0x1;},FPGA经过译码后,FPGA的对应输出管脚应该是一直是高电平,但是我用示波器看却是方波,也就是DSP端写高后,又被拉低了,然后我测了地址线、数据线,读写线、CS线,都是正确的,唯独BA1这根地址线是方波,高低电平变化,请问成龙的工程师,为什么会发生这样的情况呢,我实在没想通,还希望创龙的工程师帮帮忙
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