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您好Xilinx用户。
我对FPGA中的实际值计算有疑问。 我用实数编写编码，编码工作正常但是如果我实现设计我得到了真正的错误bcoz。 我如何在FPGA中合成该编码。请帮助我。 问候， 卡西克。 小号.......... Vi MIcrosystems（P）.Ltd，.. Chennai -96 印度 以上来自于谷歌翻译 以下为原文 Hello Xilinx Users. I have a doubt regarding the real value calculations in FPGA's . I write the coding with real number in that coding working fine in Simulation But If i implement the Design i got error bcoz of the real vlaue . how can i synthesise that coding in FPGA. Please help me. Regards, Karthick . S.......... Vi MIcrosystems (P).Ltd,.. Chennai -96 India 
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5个回答
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嗨，
你能否解释这个问题的更多细节？ 您使用Vivado或ISE的工具是什么？ Vivado Synthesis支持以下实际类型。 真实的：像C中的双倍 shortreal：喜欢在C中漂浮 实时：与真实相同 但是，Vivado Synthesis仅支持常量实型数据。 在原帖中查看解决方案 以上来自于谷歌翻译 以下为原文 Hi, Can you provdie more detaisl about the issue? What is the tool that you are using Vivado or ISE? Vivado Synthesis supports the following real types.
View solution in original post |
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嗨，
你能否解释这个问题的更多细节？ 您使用Vivado或ISE的工具是什么？ Vivado Synthesis支持以下实际类型。 真实的：像C中的双倍 shortreal：喜欢在C中漂浮 实时：与真实相同 但是，Vivado Synthesis仅支持常量实型数据。 以上来自于谷歌翻译 以下为原文 Hi, Can you provdie more detaisl about the issue? What is the tool that you are using Vivado or ISE? Vivado Synthesis supports the following real types.
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嗨，
确保使用合理的结构。 谢谢， Anusheel -------------------------------------------------- ---------------------------------------------搜索与之相关的文件 发布查询之前您的设备和工具。搜索相关论坛并确保您的查询不会重复。 请将帖子标记为“接受为解决方案”，以防有助于解决您的问题。请接受已接受解决方案的赞誉.----------------------- -------------------------------------------------- ---------------------- 以上来自于谷歌翻译 以下为原文 Hi, Make sure you are using synthesizable constructs. Thanks, Anusheel ----------------------------------------------------------------------------------------------- Search for documents related to your device and tool before posting query. Search related forums and make sure your query is not repeated. Please mark the post as an answer "Accept as solution" in case it helped to resolve your query. Give kudos for accepted solution. ----------------------------------------------------------------------------------------------- |
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除非你使用这样的东西http://www.vhdl.org/fphdl/old_index.html真实的是不可综合的。
另一个选择是从Xilinx IP库推断FP并使用这些块来实现您的代码。 或者您可以转到HLS路由并直接合成您的C代码。 - 如果提供的信息有用，请将答案标记为“接受为解决方案”。给予您认为有用且回复的帖子。 以上来自于谷歌翻译 以下为原文 unless you use something like this http://www.vhdl.org/fphdl/old_index.html real's are not synthesizable. Another option is to infer FP from Xilinx IP library and use those blocks to implement your code. Or you can go to HLS route and synthesize your C code directly.- Please mark the Answer as "Accept as solution" if information provided is helpful. Give Kudos to a post which you think is helpful and reply oriented. |
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SIr / Mam，
我使用的是ISE Design Suite 13.1版本和Spartan 3A DSP处理器 我使用HDL Code生成器从Matlab 2013生成代码。 但是在hdl编码器中使用实际函数生成了编码。所以我无法在Xilinx ISE中实现编码 以上来自于谷歌翻译 以下为原文 SIr / Mam, I am using ISE Design Suite 13.1 Version and Spartan 3A DSP Processor I was generate the code from Matlab 2013 using HDL Code generator. But in hdl coder generated the coding using real function .. So i can't implementedin that coding to Xilinx ISE |
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只有小组成员才能发言，加入小组>>
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