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QIANRUSHIZHANG 发表于 2019-3-1 09:51 建议 将你的问题详细描述发上来看看 |
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首先外围电路是按照datasheet接的，参考的Figure10+Figure11的方式（内部参考），其中Figure10中的C1、C2电容datasheet没给，我用的10μ和0.1μ。另外，AD的CLK我是用单片机给的40M，STDBY，PWDN_REF，OE都用单片机给低电平。CS，SCLK，SDI用单片机按照时序给高低电平以满足40M工作模式，我用的飞思卡尔XS128单片机，（3.3V供电，它的数字输出也是3.3左右，应该满足AD的输入要求）写控制字的频率应该是1M多，远低于20M。我现在用信号发生器给一个方波（最值在1V到2V之间），DA0~D09的输出不正确（我的想法是如果给一个峰峰值达到AD参考电压的方波，那么AD应该周期性输出0和1023，所以10个输出管脚的波形应该都是和输入占空比一样的方波，而如果调整输入的最值，输出的管脚中就有一些会产生变化，而现在我给一个比较大的方波输入，大多数管脚输出的是高频杂波，高位的一两个管脚好像和输入的波形基本一样，但是也不太稳，而且如果我将输入的最大值变得很小的时候，即数字输出理应恒小于512的时候，DA9依然是个方波）。最后，我的供电和地给的不是很严格，供电端数字模拟没有严格区分，AVDD、DVDD、DRVDD都接一起了，而DVSS、DRVSS都当成数字的接一起了，再加一个1欧电阻接上AVDD以隔离。 |
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