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大家好，
我有一个设计问题，我有两个域之间的接口： 输入是50MHz的16位并行数据 输出为500 MHz的1位串行数据， 对于这种情况，我需要设计一个FIFO。 任何人都可以帮助我设计FIFO，特别是最小FIFO先进深度？ 我也想知道我的输入是否改变为3个数据单元（每个16位）的突发，应该是什么深度？ 谢谢， 阿伦 以上来自于谷歌翻译 以下为原文
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1个回答
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您的输入比输出大16倍，但输出速度仅比输入速度快10倍，因此如果没有最大数据运行/数据死区时间，则无法定义fifo深度。
亲切的问候鲍勃斯特 以上来自于谷歌翻译 以下为原文 your input is 16 times bigger than your output, but your output is only 10 times faster than you input, so without a maximum data run / data dead time you cant define the fifo depth. Kind Regards Bobster |
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