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FPGA输出抖动较大，如果为DDS提供时钟，会导致DDS输出信号的相位噪声很差。建议使用低抖动的晶振为DDS提供参考源。
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您说的是晶体还是晶振啊？我之前用晶振出来的单端信号转为差分后输入9854，结果效果极差。问了人才知道晶振输出的是近似方波的时钟，晶体输出的才是正弦波。 |
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ncwuerw2 发表于 2018-11-19 10:55 AD9954可以接受有源晶振和无源晶体作时钟参考源。有源晶振的输出有各种类型，有正弦波，方波，消顶正弦波，这些都是AD9954可接受的波形，最终输出的相位噪声还是和参考源的相位噪声有很大关系，和波形关系不大。 |
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dang28 发表于 2018-11-19 11:07 但是我用80M有源晶振通过专用倍频器输出240M接入AD9854后输出信号很弱，而且杂散很大，后来换成外部80M正弦时钟就好了。 |
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输出信号的幅度和参考源没有直接关系。杂散输出和参考源的杂散有很大关系，建议您测试专用倍频器输出的杂散。另外，有源晶振输入一般采用交流耦合输入。输出正弦波的晶振也是有源晶振。 |
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dang28 发表于 2018-11-19 11:27 如果用交流耦合输入，考虑到REFCLK时钟输入脚是CMOS模式，那是不是说9854芯片或者这个系列的芯片都自带内部偏置了，能像FPGA一样能恢复出差分信号所需要的共模工作电压？但我记得AD9854的参考原理图给的不是交流耦合，是直耦合的形式啊。 |
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ncwuerw2 发表于 2018-11-19 11:39 因为这个主题一直是AD9954，所以先按AD9954来讨论。下面是AD9954的原理图截图，有源输入采用交流耦合、差分输入。 |
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