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在设计中想用上AD9254作为ADC，在设计过程中发现datasheet内部提供了多种时钟设计方案，由于设计的限制，想要省去所有方案中均推荐使用的AD951x芯片，请问是否有曾经使用过该款AD的同仁，使用直接从FPGA差分时钟引脚引出的时钟信号，是否能够满足设计的要求？
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6个回答
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您好，您的问题已经提交给ADI相关专家，将邀请专家尽快回答您的问题。谢谢！
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你的设计要求是什么？fpga输出的时钟抖动很差，不知道能不能满足要求。一般不这么做
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啊，这样，对于SNR的要求还是比较高的 |
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Ad951x系列输出jitter是fs级的，看了下cyclone III 的高速IO，output jitter 是500ps。以80MHz的时钟来看，这还算是比较大的了吧？ |
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chengh72 发表于 2018-11-2 19:07 您好！SNR与时钟的抖动性能，输入模拟信号的频率直接相关。FPGA输出时钟的抖动比AD951x系列输出的时钟差几个量级。SNR差，意味着有效位数少。 |
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