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我使用PSoC4100M。当从休眠中醒来一段时间，配置为输出的GPIO变低，这对于我的系统来说是不可接受的。我试图在冬眠前冷冻它，但这无济于事。当MCU唤醒时，PIN再次进入三态。在复位过程中是否有保持高逻辑的方法？
以上来自于百度翻译 以下为原文 I use PSOC4100M. When wake up from hibernate for a while one GPIO configured as output goes low, which is not acceptable for my system. I tried to freeze it before go in hibernate but this does not help. While the MCU wakes up, the pin goes in tristate for a while again. Is there any way to keep its high logic during reset 
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我不确定该设备是否支持在休眠期间唤醒PIN状态，但实现您的需求的一种方式是将PIN配置为开漏驱动器低，然后连接外部上拉以保持引脚状态高。
以上来自于百度翻译 以下为原文 I'm not sure if the device supports saving pin state during wake-up from hibernate, but one way of achieving your requirement could be to configure the pin as open-drain drive low, and then connecting external pull-up to keep the pin state high. |
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fbele456 发表于 2018-10-16 19:49 低功耗模式的应用笔记对于Hibernate没有任何关于GPIO保存状态的东西，但是，我从我自己的测试中知道，深度睡眠电源模式将节省/使用GPIO状态。AN92588-为Low Power设计和估计BLE应用的电池寿命 不幸的是，默认的引脚状态是复位上的三态；您可以尝试在TopDebug。CysCH中的一些组件连接，看看这是否会迫使引脚在复位期间保持逻辑高（数字输出引脚的默认状态配置为高，这真的是我唯一能想到的）。 以上来自于百度翻译 以下为原文 The application note for low power modes doesn't have anything on GPIO saving state for hibernate, however, I know from my own testing that the deep-sleep power mode will save/use GPIO states. AN92584 - Designing for Low Power and Estimating Battery Life for BLE Applications The default pin state is tristate on reset unfortunately; You could try wiring some components in the topdesign.cysch to see if that will force the pins to stay logic-high during reset (A digital output pin with the default state configured to high is really the only thing I can think of to try). |
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