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` 本帖最后由 Stark扬 于 2018-9-26 08:56 编辑 我使用的是序列因子为4的iserdes,数据输入形式为6bit的差分数据。我在对设计进行仿真时发现,转成单端后,只有最低位的数据连接到了iserdes的D端,其余均为不定态。 图中,data_in_from_pins_p[5:0]和data_in_from_pins_n[5:0]是差分之前的数据,data_in_from_pins_int是差分转单端之后的数据,从仿真中可以看出,差分转单端之后数据只有最低位有值,这是为什么? ` |
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