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7 个讨论
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liuqin123 发表于 2018-8-3 06:42 Thomas Yang 您好 1、part number是事先印在芯片上的吧? 没有在运行的时候查看频率的机制吗?运行的时候频率不会出现浮动吗? 2、刚才把csl里面的timer例程跑了一下,用定时器中的周期寄存器,设置了周期为1千万,软仿真跑完大概目测3-4秒,硬仿真一直没有跑完,如果频率是1GHz的话,应该在0.01s就能跑完啊? 还有如何设置timer的输入时钟?例程中没找到相关的设置。 谢谢! |
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哈哈哈欠 发表于 2018-8-3 06:50 用JTAG硬仿真跑通了,我设置的周期是1个亿,也就是1G。然后跑了十次,如果是1GHz的输入时钟的话,应该在10s左右,但是我反复跑了几次,都在30秒左右,莫非输入时钟是三分频? 我用的是csl里面timer的例程,例程里没有涉及到关于输入时钟的设置。 现在我想准确的得到每秒100次的定时器中断的话,应该如何设置输入时钟呢? 急切希望能得到解答,非常感谢! |
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您好, 输入时钟可以选择internal or external,可以通过TCR寄存器中的CLKSRC选择,如果选择internal,则对应的clock为CPU/6。通过CSL_tmrHwSetup可以完成CLKSRC的选择配置,在CLS下的例程中都是使用的默认配置,即使用internal clk。关于CPU主频的配置,可以参考CCS安装目录ccsv5ccs_base_5.0.3.00023emulationboardsevmc6678lgel的gel文件,其中对CPU的主频进行了配置,默认是1GHz,可以根据需要修改。 谢谢 |
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tutu11 发表于 2018-8-3 07:30 完全弄明白了,非常感谢,解释的很清楚。但是在调试的时候出现新问题了,在“6678的csl中定时器例程调试问题”,希望能给以解惑! |
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