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用逻辑分析仪设置TDI高电平触发可以查看到TRST置为高电平，TCLK时钟周期是10us，RCLK无返回时钟，BOOTMODE：11111
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是自己做的8168的板子，连接一直都是dead clock，14pin的jtag，开发环境是CCS 5.5，目前还没有找到问题出在哪里 |
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给板子有两个外部晶振都正常启振，一个27MHz，一个32KHz。按住reset连接也是dead clock，用手触摸芯片本身感觉微微发热， |
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对于多级放大电路板，在PCB布局中，电源摆放的位置应该注意什么？
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