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利用PCI express实现两片TMS320c6678le间通信，请问需要HW 或者SW的特殊设置吗？通信时间过长的理由是什么？

2827 PCI Express

问答对人有帮助，内容完整，我也想知道答案 0 本帖最后由一只耳朵怪于 2018-6-25 15:34 编辑》测试内容利用下面pdk的例程实现两片TMS320c6678le间通信测试从RC送信到EP返回的时间使用例程 C:tipdk_C6678_1_0_0_21packagestidrvpcieexamplesample 》结果通信成功得到的测试时间30ms左右不明白在哪里花费了这么长时间》问题 1 需要HW 或者SW的特殊设置吗 2 通信时间过长的理由》 ps 时间测试方法 ... ... System_printf ("Link is up.n"); if(PcieModeGbl == pcie_RC_MODE)　/* RC送信 / [ /********************************************************************/ / Push a single message to the EP then verify that it is echoed back / /********************************************************************/ / Write from RC to EP / if ((retVal = Pcie_getMemSpaceRange (handle, &pcieBase, NULL)) != pcie_RET_OK) [ System_printf ("getMemSpaceRange failedn", (int)retVal); exit(1); ] for (i=0; i [ ((volatile uint32_t )pcieBase + i) = srcBuf; ] prevCnt = TSCL; ←←←←←←←←←←←←←←←←←←←←←←←←←←←读送信前时间* / Mark that the buffer is full, so EP can process it / ((volatile uint32_t )pcieBase + PCIE_BUFSIZE_APP) = PCIE_EXAMPLE_BUF_FULL; / Note on cache coherence: Write back is not necessary because pcieBase is in* peripheral address space instead of physical memory/* / Data sent to EP.* RC waits for the loopback to be completed and receive data back from EP /* do [prevCnt2++; unsigned int key; / Disable Interrupts / key = _disable_interrupts(); / Cleanup the prefetch buffer also. / CSL_XMC_invalidatePrefetchBuffer(); CACHE_invL1d ((void )dstBuf.buf, PCIE_EXAMPLE_DSTBUF_BYTES, CACHE_FENCE_WAIT);* CACHE_invL2 ((void )dstBuf.buf, PCIE_EXAMPLE_DSTBUF_BYTES, CACHE_FENCE_WAIT);* / Reenable Interrupts. / _restore_interrupts(key); ] while(dstBuf.buf[PCIE_BUFSIZE_APP] != PCIE_EXAMPLE_BUF_FULL); prevCnt1 = TSCL;　　　　　　←←←←←←←←←←←←←←←←←←←←←←←←←←←读收信后时间 Cnt = prevCnt1 - prevCnt;　 ←←←←←←←←←←←←←←←←←←←←←←←←←←←计算送收信时间 / check all the data / for (i=0; i [ if(dstBuf.buf != srcBuf) [ System_printf ("Received data = %dnTransmited data = %dnIndex = %d.nnTest failed.n", dstBuf.buf, srcBuf, i); exit(1); ] ] System_printf ("Root Complex received data.nTest passed.n"); ] else [　　/ EP收信 / 　｝》 ps 结果 Cnt = 2931335 prevCnt = 253694 prevCnt1= 3185029 复制代码 0
2018-6-25 04:27:12　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 潘涛12345 该类别下有 39 个回答。邀请回答霍威电源该类别下有 36 个回答。邀请回答 wanglinhua2627 该类别下有 35 个回答。邀请回答普罗旺斯的薰衣草该类别下有 35 个回答。邀请回答斌无非师范该类别下有 27 个回答。邀请回答 h1654155958.0520 该类别下有 27 个回答。邀请回答 fdhsfagd 该类别下有 26 个回答。邀请回答 haikitty 该类别下有 26 个回答。邀请回答 60user22 该类别下有 25 个回答。邀请回答 HengDu 该类别下有 23 个回答。邀请回答 a7215433 该类别下有 23 个回答。邀请回答 lifei639156 该类别下有 22 个回答，其中被选为最佳答案 1 次。邀请回答 heks 该类别下有 21 个回答。邀请回答 60user185 该类别下有 21 个回答。邀请回答 hkhwdz 该类别下有 21 个回答。邀请回答 testd27 该类别下有 21 个回答。邀请回答 cs110 该类别下有 21 个回答。邀请回答云汉007 该类别下有 20 个回答。邀请回答 Tutut 该类别下有 20 个回答。邀请回答 tinlyxian 该类别下有 20 个回答。邀请回答举报李之相关推荐 • 两片TMS320C6678 DSP的供电需求怎么满足？ 2362 • 多片6678的同步调试问题 1817 • 基于多核数字信号处理器TMS320C6678的嵌入式双千兆网络接口 1890 • FPGA系统设计中应该如何设计两片之间的通信？ 1885 • 请问一片2812怎么和两片AD2S1200进行并行通信，硬件电路怎么设计比较简单？ 1678 • PC通过PCI Express与FPGA通信 2491 • FPGA系统设计中，如果用两个FPGA工作，应该如何设计两片之间的通信？ 3511 • 246-基于TI DSP TMS320C6678、Altera FPGA的CPCI处理卡 6889 • C6678的芯片有什么特点？ 3323 • 请问哪位大神可以分享一下tms320c6678最小系统的原理图? 1963 8个回答

答案对人有帮助，有参考价值 0 得到的时间是cnt，如果按照1GHz来算的话，耗时2.9ms

2018-6-25 04:33:43 评论举报杨娟

答案对人有帮助，有参考价值 0 zbb9612 发表于 2018-6-25 04:33 得到的时间是cnt，如果按照1GHz来算的话，耗时2.9ms CPU频率是1GHz，实验用的是TI提供的例程如果没理解错的话，例程做的事是将160bytes由RC发送给EP， EP接收后原封不动的反传给RC。 PCIe设置为1lane 2.5Gps 整个过程要耗时·2.9ms 好像长了点儿不明白2.9 ms的时间花费在那些处理上了？如果能帮忙解答的话十分感谢

2018-6-25 04:45:49 评论举报李之

答案对人有帮助，有参考价值 0 testd022 发表于 2018-6-25 04:45 CPU频率是1GHz，实验用的是TI提供的例程如果没理解错的话，例程做的事是将160bytes由RC发送给EP，如上测试中的所用CNT时间不光是PCIE lane上传输时间，还包括了测试程序指令执行时间，及PCIE IP延时

2018-6-25 04:56:17 评论举报高欢

答案对人有帮助，有参考价值 0 liuqin123 发表于 2018-6-25 04:56 如上测试中的所用CNT时间不光是PCIE lane上传输时间，还包括了测试程序指令执行时间，及PCIE IP延时谢谢您的解答。实际上我刚开始学习使用PCIe TI C66x系列也是第一次接触但是程序指令的执行时间是不是有些过长 160bytes传输来回要2.9ms，那么可不可以认为单程1.45ms 这样算来数据的吞吐量大概为 160bytes/1.45ms=0.11MBps 完全达不到 sprabk5a.pdf 中的吞吐量诚然只有1lane 2.5G好像也太慢了不知道是不是还要设置硬件的实验环境（boot， CLK等）还是软件还需要另行设置期待您的答复

2018-6-25 05:13:25 评论举报李之

答案对人有帮助，有参考价值 0 testd022 发表于 2018-6-25 05:13 谢谢您的解答。实际上我刚开始学习使用PCIe TI C66x系列也是第一次接触你好，下面的数据请你参考在PCIe传输过程中需要进行8b/10b的解码，而且协议中的数据包头等它都是要占用传输带宽的，用公式简单算下： 2.5G×8/10（8b/10b编码消耗）×84%（协议消耗）×1byte/8bits=210Mbyte/s（理论值）至于你的0.11Mbps不应该是时间除以二的，建议你测下开始发和全部发完所用时间再进行计算。

2018-6-25 05:23:14 评论举报孙榕

答案对人有帮助，有参考价值 0 hfjydz2013 发表于 2018-6-25 05:23 你好，下面的数据请你参考在PCIe传输过程中需要进行8b/10b的解码，而且协议中的数据包头等它都是要占用传输带宽的，用公式简单算下：谢谢大家的解答。已经找到原因了。在测试RC→EP→RC的传输过程时间中，包含了两个花时间的项目。 1 EP收信处理后，给RC再送信之前做了一下分配地址的处理。 /* Loopback to RC what was written in the DST buffer. Write from EP to RC */ if ((retVal = Pcie_getMemSpaceRange (handle, &pcieBase, NULL)) != pcie_RET_OK) [ System_printf ("getMemSpaceRange failedn", (int)retVal); exit(1); ] 2 系统向Console写接收结果，可能是使用中断了吧，花了一些时间 System_printf ("End Point received data.n"); 以上两项排除在测试之外后，所得结果约为1.245us（128bytes 约205MBps payload）大致在理解的范围内。

2018-6-25 05:31:20 评论举报李之

答案对人有帮助，有参考价值 0 你好，请问你是通过boc的那块板卡，将两块evm板进行连接的么？我现在用这种方式发现两边导入程序，都会卡在 CACHE_invL1d ((void *)dstBuf.buf, PCIE_EXAMPLE_DSTBUF_BYTES, CACHE_FENCE_WAIT); 这里不知道你有什么建议？谢谢

2018-6-25 05:45:51 评论举报王明钊

答案对人有帮助，有参考价值 0 liuqin123 发表于 2018-6-25 04:56 如上测试中的所用CNT时间不光是PCIE lane上传输时间，还包括了测试程序指令执行时间，及PCIE IP延时请问，这种方法是用BOC连接的么？需要对example进行什么修改么？我这边link up老是掉，好奇怪

2018-6-25 06:04:42 评论举报王明钊

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