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本帖最后由 一只耳朵怪 于 2018-6-22 11:15 编辑
DMM_LISA_MAP_0/1/2/3分别和硬件是怎样的对应关系? 根据http://www.61ic.com/Article/DaVinci/TMS320DM81x/201303/47739.html 应该是: DMM_LISA_MAP_0 -> EMIF0 (硬件:DDR0_CS0) DMM_LISA_MAP_1 -> EMIF0 (硬件:DDR0_CS1) DMM_LISA_MAP_2 -> EMIF1 (硬件:DDR1_CS0) DMM_LISA_MAP_3 -> EMIF1 (硬件:DDR1_CS1) 但是如果根据这样的理解,这篇帖子 http://processors.wiki.ti.com/index.php/EZSDK_Memory_Map 又存在矛盾,为什么帖子中(下面是摘抄): __raw_writel(0x0, DMM_LISA_MAP__0); /* Register 0 is unused */ __raw_writel(0x0, DMM_LISA_MAP__1); /* Register 1 is unused */ __raw_writel(0x80540300, DMM_LISA_MAP__2); /* Register 2 maps 0x80000000 to 0x00000000, length 512MB */ __raw_writel(0xA0540300, DMM_LISA_MAP__3); /* Register 3 maps 0xA0000000 to 0x00000000, length 512MB */ 又把 DMM_LISA_MAP__0 和DMM_LISA_MAP__1设置为无效? 我的板子只用了DDR0_CS0和DDR1_CS0那应该怎么设置呢? |
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2个回答
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你好,
首先澄清一下, 你对于帖子中提到的那边文章的理解是有误的,文章中并没有表达列如DMM_LISA_MAP_0 -> EMIF0的硬性对应关系。你需要参考TRM手册中的DMM/TILER章节。根据LISA寄存器的描述,9-8bit是用来控制EMIF的映射关系。也就是说你可以任意选着LISA_MAP寄存器与EMIF的对应关系。 |
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cmh8 发表于 2018-6-22 04:13 谢谢 Louis: 我已经明白为什么了,以前不理解最后的8位。 原来最后8位指的是实际映射的物理偏移地址。 |
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