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我是6678初学者，正在做核间通信。现在遇到一个比较纠结的问题，如题。
具体操作如下： 1.在DDR3空间中静态定下3个数组A1、A2、A3， 2.在A1中初始化一组数值， 3.让CORE0对A1处理，并赋值到A2 4.CORE0通过MessageQ通知CORE1 /*以上都没有问题，但接着：*/ 5.CORE1中的A2并没有变化（就是说CORE0对A2的处理没有影响到CORE1中A2的数值） 6.我让CORE1通过指针对A2处理并赋值到A3，于是赋值到A3的数值也出错了 后来我又对DDR3设置了共享区，然后建堆分配空间来处理它，但问题依然存在。 请问这是仿真器的设置问题还是需要再加入某些保护或同步的模块？ 欢迎一切有启发的回答，谢谢。 
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4个回答
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看起来像cache一致性的问题,可能性比较大的是L2的cache一致性导致的
检查一下你是否enable了L2 cache，如果enable了那需要做cache一致性维护 core1 writeback A2 core2 invalidate A2 |
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听你喜欢的歌 发表于 2018-6-21 08:33 谢谢您的回复，也看到了相关的帖子了，我想可能如您所说是L2没有及时更新数据的问题 我是要先去看下cache的文档了。。。 |
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可以先将cache功能关闭，之后在按照上面的顺序看下。刚刚搞多核的时候，这种问题经常遇到，或者选择IPC通讯（少量数据）
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听你喜欢的歌 发表于 2018-6-21 08:33 刚刚大概看了下cache一致性的内容，加了个模块，然后用你说的方法试了下，问题基本解决了，再次谢谢你的回答~ |
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