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卿小小_9e6

经验：积分：1962

工程师中科驭数

北京海淀丨设计开发工程师

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他的提问 2 他的回答 437 去回答

回答了问题 2020-1-10 10:57

如何用乘加器（mac)实现150个数平方和？

炎叶00
学生

看仿真波形，rom地址为0的值440读取了两个时钟周期，由于mac与rom的读取处于同步状态，那么地址0的值就行进行了两次操作。 //------ 我安装的QuartusII不知道为什么没有这个rom的IP，没法搭工程。理论上讲这个IP应 ...
回答了问题 2020-1-9 09:21

FPGA新手

dt1239672197
学生

学如逆水行舟，不进则退。学习没太大的窍门，努力加油。不看说明，直接能看懂代码；后续不参考资料，直接自己写代码；建立自己代码库。
回答了问题 2020-1-7 17:34

reg_A<= { reg_A[14:0], 1'b1 }; //这句话怎么理解

willis.lv
哈尔滨工业大学深圳研究生院

向左移位并补位（补1）。此种情形常用于串口通信（UART/I2C/SPI）。假定reg_A初始值为16'b0001_0011_0111_1001，随着时钟变化的运算结果： a. 16'b0010_0110_1111_0011 b. 16'b0100_1101_1110_0111 c. 16'b1001_ ...
回答了问题 2020-1-7 14:40

关于DSP烧写程序的问题

卤鸭
学生

外围电路不同，需要修改寄存器配置和引脚分配。逻辑代码可以直接copy。
回答了问题 2020-1-6 20:06

请问sdram中ref_timer计数器的值的问题？

对方告诉对方
学生

//------前提，参考代码注释。 Verilog中always块对于未特别说明的寄存器，一般采用锁存器处理。 //------说明，参考代码修改。仿真波形里，对于寄存器的值查看方式有多种，unsigned无符号数和signed有符号数。截图 ...
回答了问题 2020-1-6 09:43

求助：基于FPGA的数字频率计设计

哈哈哈GG
学生

a. “响应时间不高于250ms”，In~Out的时间≤250ms，即250ms内测完； b. “测量精度不低于10Hz”，（个人理解这句话表达方式错了）能识别的最低频率为10Hz（甚至更小）。 ...
回答了问题 2020-1-2 08:18

LGA-12封装焊接问题

sinapak
工程师华亚威

a. 最常见原因是焊接温度过高：包括直接焊接温度过高，以及长时间焊接（热风枪长时间吹、电烙铁长时间接触，可以通过散热片在一定程度上减轻此种情况）。 b. 相对常见原因：使用外力过大（例如使劲按压、插拔）。 c. ...
回答了问题 2019-12-27 08:40

Altera DDR3读取数据异常

清Destiny
XCPB

帮顶一下，静等大神解答。
回答了问题 2019-12-26 08:45

常见的工控设备信号的的对接光耦隔离为什么要有两个光耦？

h1654155967.6716
0000

按照个人的从业经历，在隔离电压满足要求的前提下，一个光耦就够了，剩下的逻辑交给三极管等电路。 //------------------------------- 特殊场合的验证性测试可能会在PCB上画两个光耦，实际使用的时候可能是预留跳线 ...
回答了问题 2019-12-25 13:59

晶振32768究竟是32.768KHZ还是32768HZ？

学习老师
技术 mdimls

32.768kHz = 32768Hz //----------------------------- 在二进制计数里面，1kB = 1024b.
回答了问题 2019-12-25 10:16

【高分奖励】用的是ULN2003,不明白为什么会发热？

赵静
研发工程师多铁克

//-------------------------------发热解决办法如果发热不是很严重的话，一般只需给ULN2003外接散热片就可以了。可以尝试添加散热片和风扇，然后看温度能否降下来在可接受范围内。 //--------------------------- ...
回答了问题 2019-12-20 17:17

用fpga驱动AD9517-0输出一个差分时钟

有朝一日成大神
FPGA

如果寄存器0x01F的值是0x4E，请尝试查看DLD（Digital Lock Detect）的相关内容。
回答了问题 2019-12-20 10:27

用fpga驱动AD9517-0输出一个差分时钟

有朝一日成大神
FPGA

//----------------------------------------------- 读出寄存器0x01F的值是0x0E(二进制8'b0000_1110) 左数第二位为0，表示VCO calibration未完成。建议重新检查寄存器配置，另外就是查看寄存器配置流程是 ...
回答了问题 2019-12-14 19:57

哪位大佬会Verlog HDL语言设计洗衣机控制器

神经蛙111111
学生

需求有的地方描述还是有点模糊不够准确。 1/2/3/4功能基本实现。 5完成了仿真。不会word，不会写文档。 //------------------------------------------------------ 源码、仿真、波形、源文件如下： ...
回答了问题 2019-12-12 16:27

请教各位大佬最近在做一个基于FPGA的PPM调制系统根据网上的代码编写了一段代码

你很皮喔

代码没有问题，查一下例化的clk_out模块设置是否有问题。我仿真了一下，跳过了clk_out模块（不清楚你想怎么设置），信号有输出，FPGA_TEST2也有输出。另外，建议查硬件。首先排查时钟。 //----------------------- ...

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