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张奥

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他的提问 45 他的回答 407 去回答

回答了问题 2020-7-28 10:30

Virtex-7 FPGA中的VRP和VRN如何连接？

chm10

嗨， FPGA在几乎所有存储体中都有DQS引脚，但只有在将DQ / DQS连接到存储器DQ / DQS时才需要连接VRP和VRN。因此，只有BPI闪存且没有DDR3的银行不需要VRP和VRN引脚。请通过Xilinx DCI部分UG471获取完整的数据希望 ...
回答了问题 2020-7-27 15:19

F207+FreeRTOS 多线程跑一段时间线程会死掉是什么原因？

蒋jiang

您好，这个问题您找到原因了么？能不能分享一下排查的经验啊？
回答了问题 2020-7-27 13:23

想在F1上播放黑白MJPEG视频能实现吗？

LynnQ

本人不喜欢超频。可以考虑使用160*120分辨率视频，然后再进行两倍放大，就能全屏了，这样解码轻松点。
回答了问题 2020-7-27 07:11

求PDF格式的KC705原理图？

xbxsxj

嗨，请找到atatched 问候， Vanitha。 -------------------------------------------------- -------------------------------------------请在发布前进行谷歌搜索，您可能会找到相关信息。请留下帖子 - “接受为 ...
回答了问题 2020-7-26 18:46

请问GTH支持SATA 3.0吗？

mzxcz

嗨西昆， 7系列GTH的Transreceive向导不为您提供SATA的直接设置。您需要使用“从头开始”选项并参考文章。这是你在pg168-gtwizard.pdf中找不到的原因。所以当你从头开始使用向导时，你需要使用http://www.xilinx. ...
回答了问题 2020-7-26 08:34

Artix-7 SODIMM的硬件无法运行是为什么？

723662364d

HI，电源引脚电压不合适，端接不正确或未使用的引脚默认为标准，可能会产生更高的电流消耗。如果您使用HR银行尝试使用不同的IN_TERM值。检查ODT是否正确断言并连接。你做过IBIS模拟，SI很好吗？ Reagrds， Vanit ...
回答了问题 2020-7-25 11:16

KC705评估板中错误的解决办法？

60user175

嗨，对于将存储器系统输入时钟sys_clk.ref_clk置于其中一个存储体内的CCIO引脚上的DDR3接口，MIG将DIFF_SSTL15 I / O标准（VCCO = 1.5V）分配给CCIO引脚。由于DIFF_SSTL15和LVDS输入使用相同的差分输入接收器，因 ...
回答了问题 2020-7-25 11:08

KC705评估板中错误的解决办法？

60user175

嗨，对于将存储器系统输入时钟sys_clk.ref_clk置于其中一个存储体内的CCIO引脚上的DDR3接口，MIG将DIFF_SSTL15 I / O标准（VCCO = 1.5V）分配给CCIO引脚。由于DIFF_SSTL15和LVDS输入使用相同的差分输入接收器，因 ...
回答了问题 2020-7-24 07:48

50Ω对应的数据速率是否低于1333Mbps？

60user175

嗨， UG586图1-88和89表示1,333 Mb / s及更高。 ①40Ω是否与1333Mbps及更高的数据速率对应？ - 是 ②如果①是正确的，50Ω对应的数据速率是否低于1333Mbps？ -是问候， Vanitha -------------------------------- ...
回答了问题 2020-7-24 07:47

Xilinx在Artix设备上是否有6G-SDI的IP？

张友芬1

嗨，收发器可能具有6G功能，但6G SDI协议尚未具备独立IP功能。因此，您可以尝试联系您的经销商FAE / Sales，他们可能会提供联系营销团队的路线图（如果有的话） http://www.xilinx.com/company/contact/auth-disti ...
回答了问题 2020-7-24 07:25

50Ω对应的数据速率是否低于1333Mbps？

60user175

嗨， UG586图1-88和89表示1,333 Mb / s及更高。 ①40Ω是否与1333Mbps及更高的数据速率对应？ - 是 ②如果①是正确的，50Ω对应的数据速率是否低于1333Mbps？ -是问候， Vanitha -------------------------------- ...
回答了问题 2020-7-24 07:14

Xilinx在Artix设备上是否有6G-SDI的IP？

张友芬1

嗨，目前没有6G SDI可用，如果你看到它在XIlinx ARs或任何其他网站上做广告，请分享它进行交叉检查问候， Vanitha -------------------------------------------------- --------------------------------------- ...
回答了问题 2020-7-24 06:44

Xilinx在Artix设备上是否有6G-SDI的IP？

张友芬1

HI，我不认为目前的Vivado版本有6G-SDI但只有3G-SDI，我认为可能有一个地图但不确定时间表请查看下面的3G SDI信息链接 http://www.xilinx.com/products/intellectual-property/SMPTE_SDI.htm 问候， Vanitha - ...
回答了问题 2020-7-23 10:26

完成DDR3校准的MIG IP失败的原因？

qwe050

嗨，我认为你在写入阶段会看到不一致的模式，所以我怀疑如果你的电路板没有符合任何设计指南，你是否看到一块板或多块电路板出现故障？你能分享你的长度细节吗？ Pease尝试使用Vivado 2014.1并降低内存频率并检查 ...
回答了问题 2020-7-23 10:15

如何找到RIO的确切模型?

Sabrina_cc

嗨，请参阅UG899的“使用IBIS模型”部分 HTTP：//www.xilinx.com/support/documentation/sw_manuals/xilinx2014_1/ug899-vivado-io-clock-planning.p ... 另请查看此链接 http://forums.xilinx.com/t5/Spartan-Fami ...

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