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范佳慧

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他的提问 33 他的回答 108 去回答

回答了问题 2019-8-1 10:26

如何找一个真正的16位除法？

hgjhgd

亲爱的男士，谢谢你们的答案。时钟频率为160Mhz。（不是1 Khz）我忘记了，但回复仍然有效。最好的问候。
回答了问题 2019-7-19 09:42

请问怎么才能在Spartan 6 Deserialier上抖动简单地反序列化6个？

hgjhgd

亲爱的奥斯汀，问题我们有8个LVDS数据通道，560Mbps和1个时钟280MHz（DDR），我们将其反序列化为14比1 8个频道中的7个无误地工作。具有最大延迟的1个通道在来自bitlip的50-100个时钟周期之后产生1位移位错误，其 ...
回答了问题 2019-7-19 09:30

请问怎么才能在Spartan 6 Deserialier上抖动简单地反序列化6个？

hgjhgd

亲爱的奥斯汀，我在论坛中找到了这个。解串器的输入数据和输入时钟之间是否存在相位要求？ http://forums.xilinx.com/t5/Spartan-Family-FPGAs/Problem-with-phase-detector-on-Spartan-6/td-p/77309 11-02-2011 0 ...
回答了问题 2019-7-17 14:50

调试Microblaze应用程序出现处理器无法停止的错误

送终鸡酒

或代码与其他设计不同时钟不存在，应该检查买一个测试点。我建议检查代码是否存在相关警告，同时将时钟放在测试点上并查看它是否存在，并且它也在Microblaze窗口的FPGA代码中正确连接到Microblaze。以上来 ...
回答了问题 2019-7-16 14:53

Spartan 6重置全局路由不要在CLB内部使用逆变器

hgjhgd

亲爱的Gabor， - 我正在使用正在使用有效高异步复位的Xilinx解串器模板。 - 是的，我有太多的负载来自现有的具有低有效异步重置的代码 - 我编写的新块根本不使用重置。只是初始化值但独立于负载我想学习实现具 ...
回答了问题 2019-7-16 14:26

Spartan 6重置全局路由不要在CLB内部使用逆变器

hgjhgd

我已经实例化了pll并锁定了输出，我使用计数器创建了延迟信号。我担心的是，我需要通过AND两个信号产生的信号是否会使用全局路由？ GSR信号在配置期间始终置为有效，并且可以在配置后使用STARTUP_SPARTAN6原语进行 ...
回答了问题 2019-7-15 15:25

请问在做一级倒立摆时首先电机要选什么类型的？

60user119

http://www.cirmall.com/circuit/1651/【大学生电子设计竞赛作品】简易旋转倒立摆及控制装置#/details
回答了问题 2019-7-12 08:47

如何在同一PLL的输出之间建立固定的关系？

hgjhgd

感谢您的帮助。我将准备这些并明天更新。如果您能同时评论PLL属性和设置，我将很高兴。哪些设置很重要？以上来自于谷歌翻译以下为原文 Thanks for the help. I will prepare these and update you tomorrow. ...
回答了问题 2019-7-12 08:25

如何在同一PLL的输出之间建立固定的关系？

hgjhgd

是的，相位关系应该是恒定的，但不是。我有一个2GHz的示波器，我关闭电源并从示波器检查。输入时钟的抖动小于50ps，相位相差10ns，具体取决于电源周期。以上来自于谷歌翻译以下为原文 Yes the phase relat ...
回答了问题 2019-7-12 07:47

如何在同一PLL的输出之间建立固定的关系？

hgjhgd

即使我输入相移=> 40mhz输出和280mhz输出之间的相位关系对于每个功率周期是随机的（（甚至不依赖于编译。我关闭电源然后再次打开然后在FPGA的所有时钟输出之间的不同相位）以上来自于谷歌翻译以下为原文 Eve ...
回答了问题 2019-7-12 07:33

如何在同一PLL的输出之间建立固定的关系？

hgjhgd

在第100页的ug382.pdf中，我找到了下面的句子。在此示例中，参考时钟和输出时钟之间没有相位关系然而，在输出时钟之间需要相位关系。我的目的是在FPGA的输出时钟之间建立固定的关系。这是我想要的吗？检查频率 ...
回答了问题 2019-7-11 12:19

如何只分配一个银行约束而不是给出特定的IOB引脚？

hgjhgd

约束有效。 NET“数据”LOC = BANK0; 正确的文档是 http://www.xilinx.com/support/documentation/sw_manuals/xilinx13_3/cgd.pdf第172页以上来自于谷歌翻译以下为原文 the constraint works. NET "data" LO ...
回答了问题 2019-7-11 11:37

如何只分配一个银行约束而不是给出特定的IOB引脚？

hgjhgd

约束有效。 NET“数据”LOC = BANK0; 正确的文档是 http://www.xilinx.com/support/documentation/sw_manuals/xilinx13_3/cgd.pdf第172页在原帖中查看解决方案以上来自于谷歌翻译以下为原文 the constraint wo ...
回答了问题 2019-7-11 02:57

如何实现ucgui的触摸屏按下button控件按钮？

ya54031

哈哈，我现在在一家变态的台企工作，电脑出了浏览网页，下载资料外，什么都做不了。开发程序都是用自己的电脑，也连不上公司的网络的。所以，你就直接跟帖就好了，如果没有及时回复你，你短消息提醒下就好了。 ...
回答了问题 2019-7-9 10:24

一种基于ATF54143的微波LNA设计介绍

青上也

3 结束语现代社会对低成本以及高性能无线通信产品的需求大大推进了射频集成电路的发展，使得射频电路设计成为人们研究的热点。微波LNA是接收机的关键部件。因此提高前端LNA的性能对改善整个接收机的灵敏度具有重要 ...

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