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通过Virtex5 FPGA上的SATA连接将数据流式传输到HDD或SSD的可行性

全部:我目前正在探索通过Virtex 5 FPGA上的SATA连接将数据流式传输到HDD或SSD的可行性。
我很难找到如何做到这一点的示例,或者它是否可行。
到目前为止,我已经找到了LDS-SATA_HOST-XV5串口主机控制器IP。
Xapp870.pdf显示了如何使用HDD初始化SATA链接,但仅此而已。
在本应用笔记的最后,它表明已经证明Virtex-5支持SATA扩频时钟。
但是,除了结论之外,我找不到任何提及......在网上我发现了一个有点陈旧的讨论,似乎表明V5不支持扩频时钟。
显然,使用Virtex 4在ML405上运行了一个演示,但我能找到的只是源代码。
这显然是一个“黑客”解决方案,可以添加OOB信令。
无论如何,描述这种设计的应用(Xapp716.pdf)可能有有用的信息,但似乎并不存在...... Ug196.pdf说SATA Generation 1/2,Rev。1.0a和SATA Generation 2,Rev。
支持1.0a协议。
所以在我深入研究这个项目之前,我很好奇是否真的可以使用V5 GTP?
他们是否像宣传的那样工作?如果是这样,有人在这做过吗?任何帮助,想法或评论都会非常感激。谢谢,筹码

回帖(3)

张磊

2020-6-2 06:54:34
好,
对不起,我很累,
是的,你说你见过Xapp 870,dah ..
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杜喜喜

2020-6-2 07:08:06
谢谢你的回复。
我也看过那个帖子。
从我从GTP文档中可以看出,只要时钟频率超过2Gb / s(即SATA II),它就可以处理扩频时钟。
这个问题起源于一个关于这个话题的线程,其中一位Xilinx FPGA大师明确表示即使V5也无法跟踪扩频时钟,但这个帖子已经差不多3年了,我猜它现在可以跟踪
它在数据表和xapp870中都这么说。
因此,我发现关于将SATA驱动器连接到FPGA的信息非常少,我认为这是可行的,而不是很多人尝试过(或记录下来的)。
芯片
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张磊

2020-6-2 07:19:48
在平行的轨道上
这些家伙拥有适用于V4和V5的SATA内核,但它确实只说SATA 1。
QED必须是可能的。
http://www.xilinx.com/products/ipcenter/ASICSWS_SATA_H1.htm
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