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陈俊

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[问答]

如何设计定制的AXI-lite主IP?

嗨,
我开始使用Vivado了。
我正在尝试配置从Dram读取数据的自定义IP,处理它们然后将结果发送到Bram控制器。
我想过使用AXI主接口制作自定义IP。
但是,我不知道将AXI主信号连接到我的自定义逻辑,以便我可以从Dram读取数据并将结果发送到Bram。
谢谢。

回帖(1)

陈苏文

2020-5-14 06:52:36
这有点容易。
在vivado中,转到工具|
创造&
包IP |
下一个|
创建一个新的AXI4外设|
接下来。在这里你应该看到一个带有单个从属外设的默认IP。
我想你想要一个带有一个从机和两个主机外设的IP。
Slave将有助于控制您的主控,即从哪里读取,在哪里写入,大小等。其中一个主设备将用于从DDR读取,另一个将用于写入BRAM。
如果你想真正想要的话,你只能拥有一个主设备,并分别改变它所用的地址来读/写DDR / BRAM。
然后,将自定义逻辑嵌入到IP的顶层,以便数据来自读取主机,流入处理块并流出到另一个要写入的主机。
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