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` EE对话第二期：FPGA代替一切芯片的可能性有多高？ 当今，半导体市场格局已成三足鼎立之势，FPGA，ASIC和ASSP三分天下。市场统计数据表明，FPGA已经逐步侵蚀ASIC和ASSP的传统市场，并处于快速增长阶段。因此，研发具有自主知识产权的FPGA技术与产品对打破美国企业和***结合构成的垄断，及国家利益意义深远。 撰文、组稿：cindy(sunbo@elecfans.com) 主持：Elecfans管家(sunbo@elecfans.com) (原创内容，转载请注明来自Elecfans) 热门议题：
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欢迎各位用户朋友们踊跃提问或探讨，让更多的朋友来了解MCU的趋势，王工、吴工将会在本周五16:00—17:00准时在线与大家互动！ 往期回顾 ——————————————————————————————————————————————————————— EE对话第一期：替代8位MCU 谁会是最强杀手锏？ 
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代替一切芯片，可能吗？
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FPGA电路往往需要多路电源输入。为优化开机时的电流拖曳，防止开机接通时的毛刺干扰和降低开机接通的功耗，这些电源输入必须具有精确的上电序列以及正确的电压变化率
以前用过Spartan-3， FPGA需要四路供电，包括VCCint，VCCaux，VCCio和Vintf。为正确配置 FPGA，要在FPGA上电前 1ms开启，这一上电间隔保证了配置器件已完成上电，并准备好向FPGA发送来自存储器的配置。其他三路供电时序没有严格要求。当时听老工程师们的经验就是可以通过在FPGA允许范围内通过精调上电序列和变化各路供电的上电斜率来优化开机功耗，并验证消耗电流的变化。为能够快速精确调整供电设置，并实时测量消耗电流值，使用带有多路供电测量功能的高性能电源是最理想的选择，是解决FPGA供电问题的王道。选用合适的直流功耗分析仪可以帮助工程师解决FPGA电路设计验证过程中所遇到的供电相关问题哦~~~~ 我就说到这吧，坐等嘉宾答案 |
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最近，项目进行SOC在FPGA上的测试时，发现一奇怪现象，目前还没解决，哪位高手遇到过，或者有什么建议可否提供下，具体情形如下：我们采用自己的ddr controller搭配FPGA中的DDR3 PHY进行测试（PHY配置为16bit数据位宽，采用half rate模式），仿真时没有问题，但是上板子后出现了大问题：
如在写byte数据时，仿真时，两位宽的dm信号，只有一位有效，而在实际板子上采用示波器测试时，竟然发现两位dm都有效（写了16bit数据？）；在写word（32bit）数据时，两位dm有效，且保持两个dqs沿(上升沿加下降沿)，而在板子上采用示波器抓出的波形，竟然是两位dm有效，且保持了四个dqs沿（两个上升沿加两个下降沿）。 从上述测试中，我们也怀疑是DDR3 PHY配置成了8bit操作？但是我们检查了配置应该是16bit的，而且最奇怪的是，仿真竟然和上板测试完全不一样，个人猜测已经不仅仅是时序的问题了。 |
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