[问答]

Orcad中FPGA的Bank间交换管脚设置后如何在PCB中实现，请指教！

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问答对人有帮助，内容完整，我也想知道答案 0 `设计需要在Bank间交换管脚，不然PCB的布线就布不通了，交换的管脚如下图：设置完成后也能生成网表，但是在PCB中只能实现Bank内交换而不能实现Bank间的交换，也就是说Bank15里面的PinGroup的设置无效，请高手指点一二，跪谢！ ` 0
2013-4-21 22:09:50　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × z447496660 该类别下有 18 个回答。邀请回答 MUF420 该类别下有 9 个回答。邀请回答逍遥游反盗版该类别下有 7 个回答。邀请回答张少哲该类别下有 7 个回答。邀请回答赵君度该类别下有 5 个回答。邀请回答 LotusRen 该类别下有 5 个回答。邀请回答哼小曲该类别下有 3 个回答。邀请回答 beau0603 该类别下有 3 个回答。邀请回答帅的人人追该类别下有 3 个回答。邀请回答 IRZB 该类别下有 3 个回答。邀请回答 ljjvip 该类别下有 3 个回答。邀请回答 liniux5 该类别下有 3 个回答。邀请回答花涛该类别下有 3 个回答。邀请回答我的设备该类别下有 3 个回答。邀请回答 liehuzhi 该类别下有 2 个回答。邀请回答自由的飞该类别下有 2 个回答。邀请回答 Happy洋该类别下有 2 个回答。邀请回答 youyoulan 该类别下有 2 个回答。邀请回答 cn-xjh 该类别下有 2 个回答。邀请回答 Promise96 该类别下有 2 个回答。邀请回答举报 lionmon 相关推荐 • allegro 交换管脚后回标原理 18100 • 为什么ad画fpga图pcb管脚交换会导致原理图管脚变化 4759 • 如何在低端FPGA中实现DPA的功能？ 2114 • 关于FPGA 模块间进行大量数据的交换 4800 • Altera cyclone V 芯片可以在同一个BANK 实现既使用LVDS信号又使用1.8V的单端么 6940 • FPGA的管脚长期处于3.3V高电平状态，连接GPIO后无法正常加载？ 7743 • 如何在UCF文件中使用BANK0 Signal？ 1864 • power pcb2007 导入orcad网表 2772 • 将amc1200 SPICE模型转成PSPICE模型后无法在ORCAD16.5中使用，为什么？ 154 • Xilinx EDK存储器控制器MPMC引脚怎么交换？ 1027