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5个回答
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对于fpga设计，肯定需要一个统一的工作始终，也是顶层时钟，它通过fpga内部晶振分频得到，所有部件在这个时钟的控制下统一运转。在顶层时钟下，不同的部件可能运行速率不一样，这就需要由顶层时钟或者晶振的分频得到。对于时序逻辑，各个部件在控制时钟的上升沿工作还是下降沿工作，及其影响都要考虑到，还要考虑硬件的延时
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对于fpga设计，肯定需要一个统一的工作始终，也是顶层时钟，它通过fpga内部晶振分频得到，所有部件在这个时钟的控制下统一运转。在顶层时钟下，不同的部件可能运行速率不一样，这就需要由顶层时钟或者晶振的分频得到。对于时序逻辑，各个部件在控制时钟的上升沿工作还是下降沿工作，及其影响都要考虑到，还要考虑硬件的延时
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2012-7-10 21:14:24
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没人？我也不会，同求……
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同求。最好能详细点
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2012-8-17 08:38:23
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