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原理图和封装都画好了,层次原理图,ERC没有问题~~生成网表的时候,子层次图中,+3.3V节点没有了,如果将部分+3.3V节点换成+3.3V_P,则显示+3.3V_P节点(或+3.3V,显示数目比较少的),如果+3.3V全部更名为+3.3V_P ,则不显示+3.3V_P~~这个问题应该怎么解决呢~~(其他节点都正常,如+5V),由于生成网表没有报错,生成PCB后可以看出+3.3V节点在PCB中用GND来代替了,即本来电容两端是+3.3V和GND,现在都是GND了~
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