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1个回答
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电源退耦,这件事情太简单了,就是一个0.1uF的陶瓷电容接在Vcc上嘛,小明同学第一个举手。
废话少说,还是上图吧。iPad4电路原理图,第4页上部: 图上一共有3组电源,一组是给锁相环供电的模拟电源,两组给IC高速信号部分供电的,分别是1.0V和1.2V。根据电流的大小,IC预留的管脚数就不同。PLL供电只有1个管脚,1.0V的那一路PP1V0有2个管脚,PP1V2那一路有3个管脚。管脚数量直接决定了内阻的大小,外部无法改善,必须在IC设计的时候事先规范。 PLL那一路对噪声最敏感,C0605,C0606和R0604构成了一个π滤波器,R0604用电阻可以显著降低噪声,但是对启动速度有影响,为了预留将来调试的余地,位置先留着,噪声影响不大,就用0欧电阻。0.1uF X5R的电容,内部寄生电感不低,在高频端几乎没有什么容抗,因此添加了C0607独石电容,高频率下发挥作用。 为了防止Layout工程师忽视对PP1V8这一路的重视,特地标出了Trace的走线要求。因为走线会引入寄生电感和耦合电容。 PP1V2这一路用了3个电容并联,分别针对不同频段的噪声退耦,2个0.1uF电容并联,降低等效ESL和ESR。 PP1V2这一路用了5个电容并联,分别针对不同频段的噪声退耦,3个0.1uF电容并联,有效地降低了电容的等效ESL和ESR,这一路电流估计较大,着力比较猛! 基本上苹果的设计简明扼要,我也没有找到什么茬,就是花的钱比较多。 |
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