完善资料让更多小伙伴认识你,还能领取20积分哦, 立即完善>
|
|
相关推荐
1个回答
|
|
昨晚睡觉时还寻思着为什么数据采集显示出来怎么问题多多,明明全低电平居然时不时的采集到高电平,后来想想也是,两块板子(被采集信号产生板子和模拟逻辑分析仪的板子)没有共地,采集到的电平高低没有一个参考点,判断错误也就在所难免了。于是今晚共地后,多次采集数据,都很稳定的采集到并正确的显示做测试的波形。
经过今晚的努力,把几个字模存储到了cyclone的M4K产生的ROM中,然后通过VGA坐标产生的控制逻辑进行地址译码。这部分设计没有仔细深入,可能浪费的M4K比较多(利用率比较低),但这是为了FPGA逻辑地址控制部分设计相对容易设计些。 稍微对下面这个波形的采集做了测试,这个波形(被采集信号产生)是在另一块板子上做的。 三种采集模式下的波形分别如下。 1. 显示触发前采集的64次数据 2. 显示触发前采集的32次数据和触发后采集的32次数据 3. 显示触发后采集的64次数据,触发沿没有显示出来 |
|
|
|
只有小组成员才能发言,加入小组>>
4650个成员聚集在这个小组
加入小组17626.6标准中关于CDN的疑问?以及实际钳注入测试中是否需要对AE和EUT同时接CDN?
6924 浏览 1 评论
3725 浏览 2 评论
10383 浏览 1 评论
3890 浏览 4 评论
3598 浏览 0 评论
817浏览 0评论
小黑屋| 手机版| Archiver| 电子发烧友 ( 湘ICP备2023018690号 )
GMT+8, 2024-12-22 09:18 , Processed in 1.255669 second(s), Total 53, Slave 45 queries .
Powered by 电子发烧友网
© 2015 bbs.elecfans.com
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 (电路图) 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证:合字B2-20210191 工商网监 湘ICP备2023018690号