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[问答] fpga从黄金映像启动时fpga准备好之前需要多长时间?
42 xilinx FPGA
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我试图弄清楚在应用程序映像损坏并且FPGA从黄金映像启动时fpga准备好之前需要多长时间。
测量了它,但它比应用程序+ 1x黄金映像启动的3倍尝试更长。
我使用相同的时钟频率为黄金,因为用户图像是正确的?
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2020-8-13 09:39:56   评论 分享淘帖 邀请回答

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5个回答
如果您使用的是Jtag配置,请检查完成引脚状态和日志文件,具体取决于多种因素,配置类型,目标设备,配置时钟等。
谢谢和RegardsBalkrishan -----------------------------------------------
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一个答案“接受为解决方案”,以防它有助于解决您的查询。如果一个帖子引导到解决方案,请给予赞誉。
2020-8-13 09:50:44 评论

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是的我可以测量它,但我还可以计算吗?
2020-8-13 10:01:56 评论

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我想这次取决于第二张图片被破坏的方式。
如果映像如果基本上是正确的格式但包含一些错误的位,那么设备将配置但最后失败CRC测试。
正如预期的那样,加载一个好的图像需要同样的时间。
但是,如果图像严重损坏,截断或完全丢失,以便无法正常尝试配置设备,那么看门狗定时器将起作用,它将决定何时放弃尝试加载第二个图像并且
回到金色的形象。
可以在生成位流时定义定时器的超时周期(或者可以在执行MultiBoot时使用IPROG命令之前设置TIMER寄存器)。
有关计时器的更多信息,请参阅UG470的第116和145页。
Ken Chapman英国Xilinx主要工程师
2020-8-13 10:08:51 评论

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在编写应用程序映像期间切断电源时,位文件完全损坏。
监视器未设置。
什么会给这个计算时间?
2020-8-13 10:27:22 评论

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我建议你开始使用看门狗定时器;
这样你就可以有更明确的恢复时间。
如UG470的第137页所述,有4种不同的东西可以触发回退,因此它确实取决于损坏图像的性质以及是否使用看门狗定时器。
您当前没有使用看门狗定时器,因此规则一出。
由于您描述的腐败,我猜测它甚至不会在图像的末尾进行CRC,因为图像的末尾不存在。
我也怀疑它遇到了IDCODE错误,因为我怀疑图像的开头可能是Ok或完全丢失!
这可能会留下地址环绕错误。
如果是这种情况,那么时间将取决于它试图从其开始加载第二图像的地址(即从那里到地址图的末尾有多远)和时钟频率。
Ken Chapman英国Xilinx主要工程师
2020-8-13 10:39:36 评论

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