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我的Vertex 4设计在将其写入外部DRAM之前使用BRAM作为累积数据的缓冲区。
BRAM在RTL代码中手动实例化。 用户指南似乎表明只能在配置FPGA设备期间初始化BRAM内容。 在某些情况下，我的控制器希望在正常操作期间将BRAM内容返回到其初始值，而无需重置整个设计。 这可能吗？ 我该怎么做？ 
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不能。您无法将Block RAM重置回初始状态，这只能作为设备配置的一部分来完成。
------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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Roland，RAM通常没有并行数据复位，因为这将需要对每个位单元进行昂贵的并行访问，以及额外的路由复杂性。
由于这个原因，没有DRAM和没有大型SRAM具有数据复位功能。世界已经学会忍受这种限制。然而，您可以在许多设计中重置地址寄存器.Peter Alfke，Xilinx Peter Alfke Xilinx San Jose应用工程总监 |
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