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你好..
如下图所示我的层次结构是...... 当我在GUI中合成时，它是成功的。 但是当我在命令提示符下做。 它显示了这样的错误 Elaborating模块.ERROR：HDLCompiler：1654 - “../example_design/PIO_EP_MEM_ACCESS.v”第131行：从未知模块实例化模块PIO_EP_MEM_ACCESS由于其内容错误而仍然是黑盒子警告：HDLCompiler：1499 - “../example_design/PIO_EP_MEM_ACCESS .v“第78行：空模块仍为黑盒子。 所以有人可以说出问题是什么，......？ 
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@ nag.chil
尝试重新生成tx_mem_i核心并查看它是否有帮助。 您也可以尝试-sd命令行选项。 有关类似问题的建议：http：//forums.xilinx.com/t5/7-Series-FPGAs/error-HDLCompiler-1654-when-instantiating-Synpfy-pro-edf-file-to/td-p/369577。 谢谢， Sravanthi 请注意 - 如果提供的信息有用，请将答案标记为“接受为解决方案”。给予您认为有用并回复导向的帖子。 |
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只有小组成员才能发言，加入小组>>
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