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`1、在开发zynq工程时遇到多个axi_hp总线读写ddr时,总线锁死。 现象就是axi_hp的wready信号一直为低。 架构图: |
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1个回答
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本帖最后由 卿小小_9e6 于 2020-4-15 23:07 编辑
方便的话打包发邮箱看一下程序。916988627@qq.com “2”里面涉及到的AXI_HP0的wready一直为低,可能是DDR写满溢出了,不再接收数据导致前端阻塞,最终使wready拉低。 “3”里面情况不了解,是不是重新架构之后板卡没有断电?涉及到ZYNQ的部分,建议每次断电重启后再烧写程序。 |
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1 条评论
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